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编译器/解释器  这是一个词法分析器并可处理科学计数法

这是一个词法分析器并可处理科学计数法

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VHDL/FPGA/Verilog 脉冲多普勒雷达回波信号相干积累的VHDL源程序

脉冲多普勒雷达回波信号相干积累的VHDL源程序

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单片机开发  零耗时低频宽脉冲软PWM信号控制Keil C51演示程序

零耗时低频宽脉冲软PWM信号控制Keil C51演示程序，转摘！

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嵌入式/单片机编程  这是一个C8051FXXX的脉冲发送程序.

这是一个C8051FXXX的脉冲发送程序.

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其他数据库  vfp编写的简单计数器.可以轻松实现计数,清零等功能

vfp编写的简单计数器.可以轻松实现计数,清零等功能

https://www.eeworm.com/dl/645/128611.html

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其他  工业控制和数据采集,这是一个脉冲阀的控制原代码,自动控制实验过程.

工业控制和数据采集,这是一个脉冲阀的控制原代码,自动控制实验过程.

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生物技术  本系统是医院中红细胞计数的使用系统。系统硬件平台包括高倍放大镜

本系统是医院中红细胞计数的使用系统。系统硬件平台包括高倍放大镜，图像采集卡，社戏囊头，高性能计算机等。它具有误差小，界面简单，容易操作等优点。

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数据结构  该程序是分布计数排序

该程序是分布计数排序，它是我所见过的各种排序方法中最快的，它的时间复杂度为O(n),但是这种排序适用于已知待排序列的上下限，并且如果上限与下限的差值比较大的话，空间消耗也比较大．

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VHDL/FPGA/Verilog EDA常用计数函数VHDL程序设计

EDA常用计数函数VHDL程序设计，减法计数器：可预置数：

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VHDL/FPGA/Verilog 减1计数器一、设计要求用Verilog HDL语言设计一个计数器。要求计数器具有异步置位/复位功能

减1计数器一、设计要求用Verilog HDL语言设计一个计数器。要求计数器具有异步置位/复位功能，可以进行自增和自减计数，其计数周期为2^N（N为二进制位数）。二、设计原理输入/输出说明： d：异步置数数据输入； q：当前计数器数据输出； clock：时钟脉冲； count_en：计数器计数使能控制（1：计数/0：停止计数）； updo ...

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