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单片机开发  Verilog HDL源码

Verilog HDL源码，显示器段数码管数字累加，测试通过

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Delphi控件源码  神经网络也许是计算机计算的将来

神经网络也许是计算机计算的将来，一个了解它的好方法是用一个它可以解决的难题来说明。假设给出 500 个字符的代码段，您知道它们是 C、C++、Java 或者 Python。现在构造一个程序，来识别编写这段代码的语言。一种解决方案是构造一个能够学习识别这些语言的神经网络。这篇文章讨论了神经网络的基本功能以及构造神经网络的方 ...

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文章/文档  C语言对于给定的消息序列,按照模p信道编码 p=37(符号的个数）数字“0”-“9”和字母“A”-“Z”和空格共37种符号。 “0” 0 “1” 1 ¨ “A” 10

C语言对于给定的消息序列,按照模p信道编码 p=37(符号的个数）数字“0”-“9”和字母“A”-“Z”和空格共37种符号。 “0” 0 “1” 1 ¨ “A” 10 “B” 11 设有某消息的符号序列为X=X1X2X3X4, 用下表的方式来求它们的和及累加和，然后加上适当的监督元，使累加和是模37的倍数 ...

https://www.eeworm.com/dl/652/386046.html

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其他  数字钟是一个将“时”“分”“秒”显示于人的视觉器官的计时装置。它的计时周期为24小时；显示满刻度为23时59分59秒

数字钟是一个将“时”“分”“秒”显示于人的视觉器官的计时装置。它的计时周期为24小时；显示满刻度为23时59分59秒，另外具备校时功能和报时功能。因此，一个基本的数字钟电路主要由“时”“分”“秒”计数器校时电路组成。将标准秒信号送入“秒计数器”，“秒计数器”采用60进制计数器，每累加60秒发送一个“分脉冲”信号 ...

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VHDL/FPGA/Verilog 通过在进程1中检测时钟上升沿

通过在进程1中检测时钟上升沿，循环累加，触发进程2，一次输出高电平，使灯发光

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汇编语言  用地址表传递参数的形式

用地址表传递参数的形式，把1到100进行累加，结果以十进制形式在屏幕上显示出来。

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单片机开发  内部定时器与中断实验由8051内部定时器0按方式1工作

内部定时器与中断实验由8051内部定时器0按方式1工作，即作为16位定时器使用，每0.1秒钟T0溢出中断一次。要求编写程序模拟循环彩灯。彩灯变化花样为：由中间（L4、L5）两位开始向两侧依次累加点亮；全亮后由中间（L4、L5）两位开始向两侧依次累加熄灭；全灭后由两边（L1、L8）两位向中间依次累加点亮；全亮后由两边（L1、L ...

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数据结构  使用如下所谓的简单变量“数据平移”方法来求出Fibonacci数列的第n项（的具体项值）并显示在屏幕上（正整数n通过键盘输入）：说明变量old1=1

使用如下所谓的简单变量“数据平移”方法来求出Fibonacci数列的第n项（的具体项值）并显示在屏幕上（正整数n通过键盘输入）：说明变量old1=1，old2=1，newItem；新的Fibonacci项newItem总是“距它最近”的前两项（old1与old2）的累加和。而后通过“old1=old2 old2=newItem ”进行所谓的“数据平移”。接着计算另一个新的Fib ...

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Java编程  网站计数器在通常情况下

网站计数器在通常情况下，网站中都包含有一个网站计数器，用于网站的访问量和流量统计。用户注册后，纪录该用户的访问次数为0。用户登录成功后，累加该用户登录的次数，并且显示该次数、该网页被访问的次数及登录后用户的基本信息。 ...

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单片机开发  采用中微半导体有限公司的66P23芯片

采用中微半导体有限公司的66P23芯片，0.5-1-2-4累加定时，温度显示范围：0~60，设置范围：15~35……

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