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VHDL/FPGA/Verilog EDA中常用模块VHDL程序
EDA中常用模块VHDL程序，不同时基的计数器由同一个外部是中输入时必备的分频函数。分频器FENPIN1/2/3(50分频=1HZ，25分频=2HZ，10分频=5HZ。稍微改变程序即可实现)
其他 OFDM接收端程序仿真
OFDM接收端程序仿真，包括循环前缀、保护间隔、导频。
技术资料 多载波CDMA技术研究.pdf
三种多载波CDMA技术 扩频 正交频分复用
技术资料 占空比百分之五十三分频器
verilog三分频占空比50%，有波形图。
编译器/解释器 算符优先实验,可以输入文法
算符优先实验,可以输入文法，生成算符优先表，输入句子，生成移近-规约过程。并且还有实验报告。
汇编语言 键盘扫描输出点初始化
键盘扫描输出点初始化，调用键盘扫描程序，每移一位,键盘接收端检测一次
系统设计方案 该文件含有自适应滤波的四篇国外经典文章,其中有连续自适应滤波的结构,无迟延子带自适应滤波器构造,FIR滤波器的时频实现等域.是自适应滤波器构造的经典文献
该文件含有自适应滤波的四篇国外经典文章,其中有连续自适应滤波的结构,无迟延子带自适应滤波器构造,FIR滤波器的时频实现等域.是自适应滤波器构造的经典文献