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技术资料 基于FPGA的CCSDS图像压缩算法研究与实现.rar
随着现代空间技术的发展,星载图像处理技术在军事侦察、森林防火、地质勘查等方面得到了广泛应用。卫星、飞船和空间站等对地观测空间飞行器能否将数据实时地从空间传送到地面,是衡量这些航天计划成败的标准之一。然而星载图像的数据量一般都较大,而且信道传输带宽有限,所以必须采用数据压缩的方法来减少传输数据量。 空 ...
技术资料 基于FPGA的SATA控制器的研究与实现.rar
SATA(Serial ATA)是一种高速的串行总线,采用点对点方式进行数据传输,内置数据/命令校验单元,支持热插拔,具有150MB/s(SATA 1.0)或300MB/s(SATA 2.0)传输速度。目前SATA应用广泛,但国内尚无独立研发的SATA芯片。 分析了SATA协议标准,建立了SATA主机控制器的层次结构,将SATA控制器划分成主机接口层、ATA适配层、 ...
技术资料 基于FPGA的CCSDS图像压缩算法研究与实现
随着现代空间技术的发展,星载图像处理技术在军事侦察、森林防火、地质勘查等方面得到了广泛应用。卫星、飞船和空间站等对地观测空间飞行器能否将数据实时地从空间传送到地面,是衡量这些航天计划成败的标准之一。然而星载图像的数据量一般都较大,而且信道传输带宽有限,所以必须采用数据压缩的方法来减少传输数据量。 空 ...
学术论文 基于FPGA的高速FIR数字滤波器设计.rar
本论文设计了一种基于FPGA的高速FIR数字滤波器,滤波器实现低通滤波,截止频率为1MHz,通带波纹小于1 dB,阻带最大衰减为-40 dB,输入输出数据为8位二进制,采样频率为10MHz。 论文首先简要介绍了数字滤波器的基本原理和线性FIR数字滤波器的性质、结构,根据滤波器的性能要求选择窗函数、确定系数,在算法上为了满足数字滤波器的要 ...
学术论文 基于ARM核嵌入式系统的AES算法优化
本文从AES的算法原理和基于ARM核嵌入式系统的开发着手,研究了AES算法的设计原则、数学知识、整体结构、算法描述以及AES存住的优点利局限性。 针对ARM核的体系结构及特点,对AES算法进行了优化设计,提出了从AES算法本身和其结构两个方面进行优化的方法,在算法本身优化方面是把加密模块中的字节替换运算、列混合运算和解密 ...
学术论文 基于FPGA的高速FIR数字滤波器设计
本论文设计了一种基于FPGA的高速FIR数字滤波器,滤波器实现低通滤波,截止频率为1MHz,通带波纹小于1 dB,阻带最大衰减为-40 dB,输入输出数据为8位二进制,采样频率为10MHz。 论文首先简要介绍了数字滤波器的基本原理和线性FIR数字滤波器的性质、结构,根据滤波器的性能要求选择窗函数、确定系数,在算法上为了满足数字滤波器的要 ...
技术资料 基于FPGA与单片机的SPI接口的实现.
在数字技术高速发展的今天,有许多芯片被用作数据交换的核心器件,以起到承上启下数据交换的权纽作用。FPGA即现场可编程门阵列,由于其运行速度快且具有可编程的灵活性,现在已经成为EDA设计的主要逻辑器件,SPI接口技术是一种高速高效率的串行接口技术,主要用于扩展外设和进行数据交换,在许多高档的单片机中,已经作为一 ...
技术资料 DS1302时钟模块(51程序+原理图)
DS1302 是美国DALLAS公司推出的一种高性能、低功耗、带RAM的实时时钟电路,它可以对年、月、日、周日、时、分、秒进行计时,具有闰年补偿功能,工作电压为2.5V~5.5V。采用三线接口与CPU进行同步通信,并可采用突发方式一次传送多个字节的时钟信号或RAM数据。DS1302内部有一个31×8的用于临时性存放数据的RAM寄存器。DS1302 ...
技术资料 基于FPGA的高速FIR数字滤波器设计
本论文设计了一种基于FPGA的高速FIR数字滤波器,滤波器实现低通滤波,截止频率为1MHz,通带波纹小于1 dB,阻带最大衰减为-40 dB,输入输出数据为8位二进制,采样频率为10MHz。 论文首先简要介绍了数字滤波器的基本原理和线性FIR数字滤波器的性质、结构,根据滤波器的性能要求选择窗函数、确定系数,在算法上为了满足数字滤波器的要 ...
技术资料 半导体芯片外观视觉检测系统的研究与开发
机器视觉在工业检测中已经得到了广泛的应用,本文针对某大型半导体企业在芯片检测过程中的实际需求及遇到的困难,利用机器视觉的优点,设计了一套基于机器视觉技术的半导体芯片外观检测系统,实现对出厂芯片连续、高效、快速的外观检测,提高了检测效率、节约人力成本并降低了工人劳动强度、更重要的是保证了检测的精度.针 ...