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秒脉冲 的查询结果
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VHDL/FPGA/Verilog 60秒秒表设计
60秒秒表设计,可暂停和分段计数等,所有功能是利用verilog HDL来描述,最后下载到CPLD/FPGA才能运行。
Delphi控件源码 DELPHI倒计时时钟源码,支持自定义倒计时秒数功能
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嵌入式/单片机编程 基于单片机的窄带脉冲宽度检测 自已去看看有没有用!!!
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其他书籍 集成音频功率放大器电路是一种可以采用数控方式产生计数脉冲实现音量调节的装置
集成音频功率放大器电路是一种可以采用数控方式产生计数脉冲实现音量调节的装置, 从原理上讲是一种典型的数字电路和模拟集成电路的组合和综合运用,因此,我们此次设计就是为了了解数控电路和功率放大电路的原理,从而学会制作数字控制电路而且通过制作进一步的了解各种在制作中用到的中小规模集成电路的作用及实用方法.且 ...
单片机开发 单片机的步进电机控制和一些具体的原理还有脉冲运动控制
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技术管理 传奇SF秒杀挂只要你的刀速度有5点就是秒杀效果
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VHDL/FPGA/Verilog 四位动态数码管显示数字时钟的分位和秒位。工具:Quartus ii 6.0 语言:VHDL
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汇编语言 单片机产生PWM波对电机进行调速 脉冲宽度调制(Pulse Width Modulation—PWM)是指将输出信号的基本周期固定
单片机产生PWM波对电机进行调速
脉冲宽度调制(Pulse Width Modulation—PWM)是指将输出信号的基本周期固定,通过调整基本周期内工作周期的大小来控制输出功率
单片机开发 最高实时取样率2M点/秒
最高实时取样率2M点/秒,精度8Bit
取样缓冲器深度:256字节
模拟频带宽度 0 - 1MHz
垂直灵敏度100mV/Div - 5V/Div (按1-2-5 方式递进)
系统设计方案 数字频率计的设计可以分为测量计数和显示。其测量的基本原理是计算一定时间内待测信号的脉冲个数
数字频率计的设计可以分为测量计数和显示。其测量的基本原理是计算一定时间内待测信号的脉冲个数,这就要求由分频器产生标准闸门时间信号,计数器记录脉冲个数,由控制器对闸门信号进行选择,并对计数器使能断进行同步控制。控制器根据闸门信号确定最佳量程。 ...