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VHDL/FPGA/Verilog systemverilog是新出现的一种高级硬件描述和验证语言
systemverilog是新出现的一种高级硬件描述和验证语言，这里给出了一些书和文章还有使用vmm方法开发testbench的例子
汇编语言 使用硬件实现,通过FPGA验证的效率较高的加法器,
使用硬件实现,通过FPGA验证的效率较高的加法器,
VHDL/FPGA/Verilog 使用硬件实现,效率较高的乘法器,通过FPGA验证的
使用硬件实现,效率较高的乘法器,通过FPGA验证的
汇编语言 使用硬件实现,效率较高的滤波器,通过FPGA验证的
使用硬件实现,效率较高的滤波器,通过FPGA验证的
DSP编程 卷积实现程序及在脉冲响应的运用验证程序,结合硬件AD与DA,本程序适合参加比赛与实验教学
卷积实现程序及在脉冲响应的运用验证程序,结合硬件AD与DA,本程序适合参加比赛与实验教学
VHDL/FPGA/Verilog 经过验证的UART硬件描述语言（VHDL）代码
经过验证的UART硬件描述语言（VHDL）代码，非常实用。
单片机开发 能在SST89E516单片机上运行的多任务实时操作系统ucosii v2.84 for keil C51源码,在硬件上已验证通过调试
能在SST89E516单片机上运行的多任务实时操作系统ucosii v2.84 for keil C51源码,在硬件上已验证通过调试
系统设计方案 介绍以太网的帧协议和以太网控制芯片的结构特性； 介绍单片机控制实现以太网通讯的硬件设计方案； 采用C语言实现并进行了系统的调试与验证。
介绍以太网的帧协议和以太网控制芯片的结构特性； 介绍单片机控制实现以太网通讯的硬件设计方案； 采用C语言实现并进行了系统的调试与验证。
学术论文 IIR数字滤波器优化设计及FPGA仿真验证.rar
IIR数字滤波器是冲激响应为无限长的一类数字滤波器，是电子、通信及信号处理领域的重要研究内容，国内外学者对IIR数字滤波器的优化设计进行了大量研究。其中，进化算法优化设计IIR数字滤波器虽然取得了一定的效果，但是其也有自身的一些不足；另外，基于粒子群算法以及人工鱼群算法的IIR数字滤波器优化设计也取得了较好的效 ...
学术论文 基于JTAG和FPGA的嵌入式SOC验证系统研究与设计.rar
随着半导体制造技术不断的进步，SOC(System On a Chip)是未来IC产业技术研究关注的重点。由于SOC设计的日趋复杂化，芯片的面积增大，芯片功能复杂程度增大，其设计验证工作也愈加繁琐。复杂ASIC设计功能验证已经成为整个设计中最大的瓶颈。 使用FPGA系统对ASIC设计进行功能验证，就是利用FPGA器件实现用户待验证的IC设计。 ...