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单片机 语言编写
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7.8等精度数字频率计的实现
单片机开发 一个ＤＤＳ前端的串口通讯编程的程序。可以实现分频和指定步进的计数。计到终点值就锁定频率。
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系统设计方案 VT6304A6 相 关 设 计 文 件
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嵌入式/单片机编程 学verilog时写的8位十进制频率计
学verilog时写的8位十进制频率计，开发环境为quartus II6.0.
单片机开发 在C51下编写的频率计函数
在C51下编写的频率计函数，可以对测得输入信号的频率
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计算分形维数的计盒算法，用于边长相等的图像的算法
VHDL/FPGA/Verilog 基于EDA技术设计4位十进制数字频率计的系统方案
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VHDL/FPGA/Verilog 数字频率计VHDL程序与仿真 文件名：plj.vhd。 --功能：频率计。具有4位显示
数字频率计VHDL程序与仿真
文件名：plj.vhd。
--功能：频率计。具有4位显示，能自动根据7位十进制计数的结果，自动选择有效数据的
--高4位进行动态显示。小数点表示是千位，即KHz。
VHDL/FPGA/Verilog 四位十进制频率计设计 包含测频控制器（TESTCTL）
四位十进制频率计设计
包含测频控制器（TESTCTL），4位锁存器(REG4B)，十进制计数器（CNT10）的原程序(vhd)，波形文件(wmf ),包装后的元件(bsf)。顶层原理图文件（Block1.bdf）和波形。