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电平指示器 的查询结果
软件设计/软件工程 1.1 一般说明 IMP705/706/707/708和IMP813L等CMOS监控电路能监控电源及电池电压和μP/μC的工作状况。当电源电 压降至4.65V以下(IMP705/707/813L)
1.1 一般说明
IMP705/706/707/708和IMP813L等CMOS监控电路能监控电源及电池电压和μP/μC的工作状况。当电源电
压降至4.65V以下(IMP705/707/813L)或4.40V以下(IMP706/708)时,即产生复位。
该系列产品能提供多种功能。每个器件在上电、掉电期间及在电压降低的情况下可产生一个复位信号。
此外,IMP705/706/813L带有一个 ...
单片机开发 显示凌阳标志动画 涉及的库: CMacro1016.lib // 组成文件: main.c/SPLC501User.c/Sunplus_Table.c // SPLC501Driver_
显示凌阳标志动画
涉及的库: CMacro1016.lib
// 组成文件: main.c/SPLC501User.c/Sunplus_Table.c
// SPLC501Driver_IO.asm/DataOSforLCD.asm
// SPLC501User.h/Sunplus_Table.h
// SPLC501Driver_IO.inc
//
// 硬件连接: LCD DB0~DB7接IOA0~IOA7
// LCD EP 接IOB5
// LCD RW 接IOB4
// LCD A0 接IO ...
单片机开发 本程序为电磁铁测试程序
本程序为电磁铁测试程序,输出波形为下面的脉冲形式,最前面一段为高电平(可调)
可调高电平最底分辨率为1MS,最大量程为999MS,后面一部分为高10MS,低20MS脉冲
___ ___ ___
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|___|.|___|.|___|.
高 中 低
____ 10_ 18_ _ _ _ _ __
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脉宽可调 小脉冲宽10MS低 ...
单片机开发 本系统是以凌阳SPCE061A单片机为核心控制器
本系统是以凌阳SPCE061A单片机为核心控制器,具有电流可预置、可步进调整、输出的电流信号和预置的电流信号可同时显示的数控直流电流源。系统主要包括:凌阳SPCE061A精简开发板、键盘与显示电路、压控恒流源电路、校正电路、电源电路等。系统中通过键盘按键对电流值进行预置,凌阳SPCE061A单片机送出相应的数字信号,经过D/ ...
汇编语言 LCD_CM160128-2C(T6963C).txt /******************************** 名称:CM160128液晶显示程序 设计:河南科技大学 创达科技 陈仲
LCD_CM160128-2C(T6963C).txt
/********************************
名称:CM160128液晶显示程序
设计:河南科技大学 创达科技 陈仲库
设计日期:2007年5月13日晚
技术服务:kuzi00@163.com QQ86828048
接口说明
LCD_CD=P2^0 LCD_WR=P3^6 LCD_RD=P3^7 LCD_CE=P2^7
CE取低电平 也可以直接接GND
P1口为数据口 间接方式 控制T696 ...
单片机开发 这个程序的任务是键盘显示数字
这个程序的任务是键盘显示数字,也就是分别按倚天版的4个小键盘,右边的数码管轮流分别显示数字0,1,2,3,为了便于程序的讲解,我们把每一句分别编号, 实际输入程序时,就不用写后面的号码了。第1,2,3行是单片机的初始化,一般的程序都是这样开头的, 作用是跳开00-30h的地址单元,因为这些单元是分配给特殊寄存器使用 ...
单片机开发 TLV1544与TMS320VC5402通过串行口连接
TLV1544与TMS320VC5402通过串行口连接,此时,A/D转换芯片作为从设备,DSP提供帧同步和输入/输出时钟信号。TLV1544与DSP之间数据交换的时序图如图3所示。
开始时, 为高电平(芯片处于非激活状态),DATA IN和I/OCLK无效,DATAOUT处于高阻状态。当串行接口使CS变低(激活),芯片开始工作,I/OCLK和DATAIN能使DATA OU ...
汇编语言 8051进行8路LED模拟分支控制 用8051的P1口作为输入、P0口作为输出
8051进行8路LED模拟分支控制
用8051的P1口作为输入、P0口作为输出,通过74LS244接8路LED模拟分支控制。
P1.0为低电平时,点亮一LED;P1.0为高电平、P1.1为低电平时点亮全部LED;当P1.0、P1.1都为高电平时,LED按四个一组,轮流反复点亮 P1.0、P1.1、P1.2都为高电平时,8LED逐一点亮并反复循环 ...
VHDL/FPGA/Verilog 设计一个字节(8 位)比较器。 要求:比较两个字节的大小
设计一个字节(8 位)比较器。
要求:比较两个字节的大小,如a[7:0]大于 b[7:0]输出高电平,否则输出低电平,改写测试
模型,使其能进行比较全面的测试 。
其他书籍 在多数情况下,集成电路芯片的管脚不会全部被使用。例如74ABT16244系列器件最多可以使用16路I/O管脚,但实际上通常不会全部使用,这样就会存在悬空端子。所有数字逻辑器件的无用端子必须连接到一个高
在多数情况下,集成电路芯片的管脚不会全部被使用。例如74ABT16244系列器件最多可以使用16路I/O管脚,但实际上通常不会全部使用,这样就会存在悬空端子。所有数字逻辑器件的无用端子必须连接到一个高电平或低电平,以防止电流漂移(具有总线保持功能的器件无需处理不用输入管脚)。究竟上拉还是下拉由实际器件在何种方式下功耗 ...