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找到约 769 项符合 电平指示器 的查询结果

VHDL/FPGA/Verilog 按键输入模块(key): --可编程延时发生器(数字同步机)的前端输入模块:0-9十个数字键按键输入模块原型 --前端模块:消抖 --对i0-i9十个输入端的两点要求: --(1)输入端要保证

按键输入模块(key): --可编程延时发生器(数字同步机)的前端输入模块:0-9十个数字键按键输入模块原型 --前端模块:消抖 --对i0-i9十个输入端的两点要求: --(1)输入端要保证一段时间的稳定高电平 --(2)不能同时按下两个或多于两个的键 --后级模块:1、编码;2、可变模计数器 --编码模块:8线-4线(0-8 BCD码) ...
https://www.eeworm.com/dl/663/138402.html
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单片机开发 红外遥控接收 ORG 0000H LJMP START 转入主程序 ORG 0010H START: MAIN: JNB P2.2,IR LJMP MAIN 以

红外遥控接收 ORG 0000H LJMP START 转入主程序 ORG 0010H START: MAIN: JNB P2.2,IR LJMP MAIN 以下为进入P3.2脚外部中断子程序,也就是解码程序 IR: MOV R6,#9 SB: ACALL DELAY882 调用882微秒延时子程序 JB P2.2,EXIT 延时882微秒后判断P3.2脚是否出现高电平如果有就退出解码程序 DJNZ R6, SB 重 ...
https://www.eeworm.com/dl/648/143250.html
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汇编语言 很好用 因为本设计是交通灯的控制

很好用 因为本设计是交通灯的控制,所以要先了解实际交通灯的变化规律。假设一个十字路口为东西南北走向。初始状态0为东西红灯,南北红灯。然后转状态1南北绿灯通车,东西红灯。过一段时间转状态2,南北绿灯闪几次转亮黄灯,延时几秒,东西仍然红灯。再转状态3,东西绿灯通车,南北红灯。过一段时间转状态4,东西绿灯闪几次 ...
https://www.eeworm.com/dl/644/144140.html
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单片机开发 PWM 码是一种脉宽调制码

PWM 码是一种脉宽调制码,它的组成为9MS 高电 平和4MS 低电平引导脉冲,16 位系统识别码 正码和8 位数据反码。我们要解的就数据码。一个PWM 码的0是由一个0.58ms的低电平和一个0.58ms的高电平
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DSP编程 交通灯实验 1.掌握交通灯控制原理 2.掌握用DSP方法驱动交通灯的方法。 17.2 实验原理 在本实验中交通灯用发光二极管模拟。这种发光二极管有三个引脚。一个接地

交通灯实验 1.掌握交通灯控制原理 2.掌握用DSP方法驱动交通灯的方法。 17.2 实验原理 在本实验中交通灯用发光二极管模拟。这种发光二极管有三个引脚。一个接地,另外两个接驱动电平。它能发三种不同颜色的光。
https://www.eeworm.com/dl/516/161120.html
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单片机开发 红外遥控器软件译码原理和程序1 红外一开始发送一段13.5ms的引导码

红外遥控器软件译码原理和程序1 红外一开始发送一段13.5ms的引导码,引导码由9ms的高电平和4.5ms的低电平组成,跟着引导码是系统码,系统反码,按键码,按键反码,如果按着键不放,则遥控器则发送一段重复码,重复码由9ms的高电平,2.25ms的低电平,跟着是一个短脉波. ...
https://www.eeworm.com/dl/648/162222.html
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其他 eda7人表决器

eda7人表决器,设计一个七人表决电路,当参与表决的7人中有4人或4人以上赞同时,表决器输出“1” 表示通过,否则输出“0”表示不通过。 实验时,可用7个电平开关作为表决器的7个输入变量,输入“1”表示表决者“赞同” 输入“0”表示表决者“不赞同”。 ...
https://www.eeworm.com/dl/534/164724.html
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单片机开发 《角度测量器》 用光电编码器测量角度

《角度测量器》 用光电编码器测量角度,每个脉冲为0.72度。 测量范围:0.0~360.0度 为保证不错过脉冲,用timer1计数,在电平跳变中断里判断转动方向,尽量加快处理过程。 数据换算和数码管扫描显示在主循环中实现。 译码器用10米长5芯屏蔽线与数显器的两片74HC595连接。 MCU为12F629,使用内部4兆RC振荡和内部复位功能。 ...
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其他 软件的使用方法极为简单。输出信号时

软件的使用方法极为简单。输出信号时,只要选中或取消引脚号,就能在相应的引脚得到相应的脉冲信号(统一为选中为高电平,取消为低电平),“清零”按钮为对应该组的所有信号清零。 输入信号的波形显示,按“开始”按钮为开始进行显示,“停止”为暂停。 ...
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VHDL/FPGA/Verilog 数控分频器设计:对于一个加法计数器

数控分频器设计:对于一个加法计数器,装载不同的计数初始值时,会有不同频率的溢出输出信号。计数器溢出时,输出‘1’电平,同时溢出时的‘1’电平反馈给计数器的输入端作为装载信号;否则输出‘0’电平。
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