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找到约 102,302 项符合 用vhdl实现数字钟 的查询结果

其他 该程序是用VHDL语言实现的扬声器程序

该程序是用VHDL语言实现的扬声器程序,可以通过不同的按键控制发出不同频率的声音。
https://www.eeworm.com/dl/534/479765.html
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matlab例程 用MATLAB实现的数字水印的生成和提取

用MATLAB实现的数字水印的生成和提取
https://www.eeworm.com/dl/665/480417.html
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其他 6位数字钟的multisim实现

6位数字钟的multisim实现,可实现跳转等基本功能
https://www.eeworm.com/dl/534/481646.html
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VHDL/FPGA/Verilog 用VHDL语言实现8421码的十进制计数器

用VHDL语言实现8421码的十进制计数器,状态变化0000->0001->0010->0011->0100->0101->0110->0111->1000->0000.循环往复。
https://www.eeworm.com/dl/663/481744.html
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VHDL/FPGA/Verilog 基于CPLD的数字通信系统2fsk 用VHDL形成2FSK信号

基于CPLD的数字通信系统2fsk 用VHDL形成2FSK信号
https://www.eeworm.com/dl/663/483290.html
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VHDL/FPGA/Verilog 基于CPLD的数字通信系统 2fsk-2psk 用VHDL产生 2fsk-2psk信号

基于CPLD的数字通信系统 2fsk-2psk 用VHDL产生 2fsk-2psk信号
https://www.eeworm.com/dl/663/483297.html
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VHDL/FPGA/Verilog 基于CPLD的数字通信系统 2m序列 用VHDL产生 2m序列信号

基于CPLD的数字通信系统 2m序列 用VHDL产生 2m序列信号
https://www.eeworm.com/dl/663/483302.html
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VHDL/FPGA/Verilog 基于CPLD的数字通信系统 ask序列 用VHDL产生 ask序列信号

基于CPLD的数字通信系统 ask序列 用VHDL产生 ask序列信号
https://www.eeworm.com/dl/663/483305.html
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VHDL/FPGA/Verilog 基于CPLD的数字通信系统曼切斯特用VHDL产生 曼切斯特信号

基于CPLD的数字通信系统曼切斯特用VHDL产生 曼切斯特信号
https://www.eeworm.com/dl/663/483306.html
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其他 数字温度计。用DS18B20实现和8051实现

数字温度计。用DS18B20实现和8051实现,简单实用。
https://www.eeworm.com/dl/534/485895.html
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