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用vhdl实现数字钟 的查询结果
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VHDL/FPGA/Verilog 在QuartusII里用VHDL仿真实现电梯控制器
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Java编程 用JAVA工具 编写程序 实现数字图像处理的中值滤波
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并行计算 用VHDL语言仿真乘法器设计。能够实现一般乘法运算。
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其他书籍 FPGAcpld结构分析 pga的EDA设计方法 fpga中的微程序设计 复杂可编程逻辑器件cpld专题讲座(Ⅴ)──cpld的应用和实现数字逻 一种使用fpga设计的DRAM控制器 用cpld器件实
FPGAcpld结构分析 pga的EDA设计方法 fpga中的微程序设计 复杂可编程逻辑器件cpld专题讲座(Ⅴ)──cpld的应用和实现数字逻 一种使用fpga设计的DRAM控制器 用cpld器件实现24位同步计数器的设计
书籍源码 用vhdl代码实现循环冗余检验
用vhdl代码实现循环冗余检验，CRC即Cycic Redundancy Check
系统设计方案 用VHDL语言设计基于FPGA器件的高采样率FIR滤波器,基于VHDL与CPLD器件的FIR数字滤波器的设计
用VHDL语言设计基于FPGA器件的高采样率FIR滤波器,基于VHDL与CPLD器件的FIR数字滤波器的设计
其他书籍 用c语言实现数字信号处理中的各种算法
用c语言实现数字信号处理中的各种算法，且有实验结果。推荐图形图像，信号处理等专业人员下载！
其他 用VHDL语言实现一个10秒倒计时电路
用VHDL语言实现一个10秒倒计时电路，要求使用8*8点阵显示计时结果
VHDL/FPGA/Verilog 该程序是用VHDL语言实现的时钟程序
该程序是用VHDL语言实现的时钟程序，用六个数码管分别显示时分秒，而且可以实现控制功能。
其他 该程序是用VHDL语言实现的时钟分频程序
该程序是用VHDL语言实现的时钟分频程序，可以把高频时钟信号分成低频时钟信号，便于实际应用。