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用vhdl实现数字钟 的查询结果
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教程资料 用vhdl实现的除法器
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VHDL/FPGA/Verilog 一篇用VHDL实现快速傅立叶变换的论文
一篇用VHDL实现快速傅立叶变换的论文，包括原理分析和代码实现，印度圣雄甘地大学M.A.学院提供
加密解密 用VC++实现数字图象迭代混沌加密方法
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VHDL/FPGA/Verilog 用vhdl实现ps2鼠标的源程序
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家庭/个人应用 本程序是用汇编语言实现数字时钟功能的.通过修改8259中断控制器的中断屏蔽寄存器(21H号端口) 打开时间中断, 实时中断, 键盘中断
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VHDL/FPGA/Verilog 用VHDL实现串口 可以实现与pc机的通信 收发 中断都可以 效果比较好
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VHDL/FPGA/Verilog 用vhdl实现双向移位寄存器 仿真环境MAXPLUS-II
用vhdl实现双向移位寄存器 仿真环境MAXPLUS-II，QUARTUS-
VHDL/FPGA/Verilog 用vhdl实现24小时计数器
用vhdl实现24小时计数器，方法简单实用。 仿真环境MAXPLUS-
VHDL/FPGA/Verilog 用vhdl实现脉冲宽度可控的一简单程序 仿真环境MAXPLUS-
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VHDL/FPGA/Verilog 用VHDL实现的键盘扫描程序 可以稍微修改就可使用
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