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中间件编程  本程序是用于WGS-84向北京1954坐标系转换的。要想进行转换需要至少3个控制点。这些控制点要已知他们在WGS-84和北京1954坐标系空间直角三维坐标。程序通过解算

本程序是用于WGS-84向北京1954坐标系转换的。要想进行转换需要至少3个控制点。这些控制点要已知他们在WGS-84和北京1954坐标系空间直角三维坐标。程序通过解算，计算出转换参量进行解算。求得转换参量后，程序通过转换参量计算待转换点在北京1954坐标系中的空间直角坐标。 ...

https://www.eeworm.com/dl/682/283947.html

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游戏  游戏编程精粹６中关于用自适度二叉树进行空间剖分

游戏编程精粹６中关于用自适度二叉树进行空间剖分，对入门的游戏开发者很有帮

https://www.eeworm.com/dl/625/284612.html

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VHDL/FPGA/Verilog 波形发生器.经典双进程状态机.相应加法器的测试向量

波形发生器.经典双进程状态机.相应加法器的测试向量

https://www.eeworm.com/dl/663/284640.html

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VHDL/FPGA/Verilog 一个牛人写的很快且不用状态机的动态RAM接口,VHDL编写

一个牛人写的很快且不用状态机的动态RAM接口,VHDL编写

https://www.eeworm.com/dl/663/284895.html

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数据结构  Task: 动态数组模版类 Requirements: 用动态空间实现代码要规范

Task: 动态数组模版类 Requirements: 用动态空间实现代码要规范，加上程序注释重载操作符[]

https://www.eeworm.com/dl/654/285166.html

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matlab例程  在目标被动式跟踪中广泛应用的伪量测变换估计器(PLE)具有良好的误差收敛性。然而由于等价噪声和状态的相关性,该估计器的估计是有偏的。提出的强跟踪滤波器(STF)通过强制白化残差具有自适应地校正估计偏差

在目标被动式跟踪中广泛应用的伪量测变换估计器(PLE)具有良好的误差收敛性。然而由于等价噪声和状态的相关性,该估计器的估计是有偏的。提出的强跟踪滤波器(STF)通过强制白化残差具有自适应地校正估计偏差和迅速跟踪状态变化的能力。STF已经在非线性系统时滞估计、故障诊断与容错控制方面取得了很好的效果。 ...

https://www.eeworm.com/dl/665/285363.html

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VHDL/FPGA/Verilog 状态机设计

状态机设计，用VHDL进行MOORE型状态机的设计。原程序以及波形图

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VHDL/FPGA/Verilog 状态机设计

状态机设计，用VHDL进行MEALY型状态机的设计。由于两个程序本身有延时现象，本实验进行了改进。

https://www.eeworm.com/dl/663/285421.html

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微处理器开发  (1)个人针对atmel提供的运行于CPU内13k空间的ram的romboot修改而成。 (2)提供了IRQ和FIQ的测试工作； (3)提供了对外部sdram的数据总线和地址总线的测试工作 (3

(1)个人针对atmel提供的运行于CPU内13k空间的ram的romboot修改而成。 (2)提供了IRQ和FIQ的测试工作； (3)提供了对外部sdram的数据总线和地址总线的测试工作 (3）提供了对spi dataflash和nor flash的访问操作 (4)实现了romboot在spi dataflash和nor flash中的升级 (5)因为受编译后文件不能超过13kbytes的限制，采用条件编译 ...

https://www.eeworm.com/dl/655/285610.html

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其他  是一款车库模拟控制系统,可以实现对当前车库存车状态的实时描述.

是一款车库模拟控制系统,可以实现对当前车库存车状态的实时描述.

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中间件编程  本程序是用于WGS-84向北京1954坐标系转换的。要想进行转换需要至少3个控制点。这些控制点要已知他们在WGS-84和北京1954坐标系空间直角三维坐标。程序通过解算

游戏  游戏编程精粹６中关于用自适度二叉树进行空间剖分

VHDL/FPGA/Verilog 波形发生器.经典双进程状态机.相应加法器的测试向量

VHDL/FPGA/Verilog 一个牛人写的很快且不用状态机的动态RAM接口,VHDL编写

数据结构  Task: 动态数组模版类 Requirements: 用动态空间实现代码要规范

matlab例程  在目标被动式跟踪中广泛应用的伪量测变换估计器(PLE)具有良好的误差收敛性。然而由于等价噪声和状态的相关性,该估计器的估计是有偏的。提出的强跟踪滤波器(STF)通过强制白化残差具有自适应地校正估计偏差

VHDL/FPGA/Verilog 状态机设计

VHDL/FPGA/Verilog 状态机设计

微处理器开发  (1)个人针对atmel提供的运行于CPU内13k空间的ram的romboot修改而成。 (2)提供了IRQ和FIQ的测试工作； (3)提供了对外部sdram的数据总线和地址总线的测试工作 (3

其他  是一款车库模拟控制系统,可以实现对当前车库存车状态的实时描述.