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浮点乘法 的查询结果
VHDL/FPGA/Verilog 使用VHDL语言描述的单精度浮点处理器。源代码来自国外网站。可实现单精度浮点数的加减乘运算。
使用VHDL语言描述的单精度浮点处理器。源代码来自国外网站。可实现单精度浮点数的加减乘运算。
编译器/解释器 输出Visual C++ 6.0 编译器中各种类型的整数和浮点值的最大值。
输出Visual C++ 6.0 编译器中各种类型的整数和浮点值的最大值。
数学计算 通过读取已有的由matlab产生的数据文件进行1024点浮点fft运算的c程序.其中,radix2()实现基2算法,ChangeOrder(）实现变址运算.
通过读取已有的由matlab产生的数据文件进行1024点浮点fft运算的c程序.其中,radix2()实现基2算法,ChangeOrder(）实现变址运算.
其他 浮点运算部件的硬件设计
浮点运算部件的硬件设计，已经经过测试，可以提高设计效率．
数学计算 实现功能： 1）具备整型数据、浮点型数据的算术（加、减、乘、除）运算功能。 依次输入第一个运算数、运算符（+
实现功能：
1）具备整型数据、浮点型数据的算术（加、减、乘、除）运算功能。
依次输入第一个运算数、运算符（+，-，*，/）,第二个运算数，然后输出结果。
结果可以作为下一个运算的第一运算数。按‘C’清屏，按‘X’退出。
例如：输入：2
+
5
输出：7
2）实现单运算符表达式计算的功能。
输入的操作数可以包含整数或浮点数 ...
汇编语言 PCSpim平台下模拟汇编语言 10进制转换任何进制 可以选择用32位浮点表示法显示
PCSpim平台下模拟汇编语言
10进制转换任何进制
可以选择用32位浮点表示法显示
通讯/手机编程 基于FGPA的浮点FIR滤波器的设计与实现
基于FGPA的浮点FIR滤波器的设计与实现
通讯/手机编程 自定制浮点FFTIFFT处理器的FPGA实现研究
自定制浮点FFTIFFT处理器的FPGA实现研究
VHDL/FPGA/Verilog 高效结构的多输入浮点乘法器在FPGA上的实现
高效结构的多输入浮点乘法器在FPGA上的实现
并行计算 采用VERILOG 语言进行设计 实现32位浮点数乘法运算 结果已经验证过 放心使用
采用VERILOG 语言进行设计 实现32位浮点数乘法运算 结果已经验证过 放心使用