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测频仪设计 的查询结果
VHDL/FPGA/Verilog 一个vhdl实现的测频计,开发环境为任何支持vhdl语言的厂商提供的开发环境
一个vhdl实现的测频计,开发环境为任何支持vhdl语言的厂商提供的开发环境
VHDL/FPGA/Verilog 本频率计具有测周、测频、测量占空比等基本功能
本频率计具有测周、测频、测量占空比等基本功能，能自动换档，误差为1%
书籍源码 射频电路设计：理论与应用：theory and applications 全部源代码
射频电路设计：理论与应用：theory and applications 全部源代码
VHDL/FPGA/Verilog 测频器
测频器，用VHDL语言编写。新手学习作品，还有好多不完善的地方，全当交流，也希望能下载本站原码学习。
matlab例程 基于超外差的瞬时测频方法的研究。请多多指教
基于超外差的瞬时测频方法的研究。请多多指教
VHDL/FPGA/Verilog 等精度测频原理的频率计程序与仿真。。希望大家能用的到撒
等精度测频原理的频率计程序与仿真。。希望大家能用的到撒
VHDL/FPGA/Verilog vhdl N-0.5分频方法设计
vhdl N-0.5分频方法设计，可以输入任意数值N，即分得到N－0.5的频率。
VHDL/FPGA/Verilog 数控分频器设计:对于一个加法计数器
数控分频器设计:对于一个加法计数器，装载不同的计数初始值时，会有不同频率的溢出输出信号。计数器溢出时，输出‘1’电平，同时溢出时的‘1’电平反馈给计数器的输入端作为装载信号；否则输出‘0’电平。
嵌入式/单片机编程 通过计算不了1S内下降沿个数,达到测频目的.
通过计算不了1S内下降沿个数,达到测频目的.
其他嵌入式/单片机内容 基于CC1020的射频modem设计文档及源代码
基于CC1020的射频modem设计文档及源代码，代码使用IAR PIC16 C语言编写的，该语言与ANSI C兼容