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流程设计 的查询结果
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VHDL/FPGA/Verilog 用StateCAD设计一个“串进并出的加法器”状态机
用StateCAD设计一个“串进并出的加法器”状态机，并使用StateCAD测试激励生成器设计测试激励，验证该状态机，掌握完整的StateCAD设计流程.
VHDL/FPGA/Verilog 以LVDS设计为例学习ISE中的时序分析以及低层布局器的使用方法 在底层布局器中对LVDS管脚进行约束的方法
以LVDS设计为例学习ISE中的时序分析以及低层布局器的使用方法 在底层布局器中对LVDS管脚进行约束的方法，底层布局器设计流程，底层布局器中的位置约束，时序分析器的使用方法，时序改进向导的使用等.
SQL Server 本系统对学生信息操作控制流程和相关数据信息进行了较为全面且科学高效的管理
本系统对学生信息操作控制流程和相关数据信息进行了较为全面且科学高效的管理，它主要分为学生级权限、办公人员权限级、班级干部级权限和管理员级权限四个权限级别。本系统基于B/S的开发模式，前台使用JSP技术开发实现，服务器为Tomcat5.0, 数据库使用Microsoft SQL SERVER 2000，并采用JDBC-ODBC桥接技术进行数据库连接。
...
系统设计方案 针对新的处理流程
针对新的处理流程，现具体描述其功能如下：
①用户登录：系统对用户进行合法检查。
②图书入库：对新购进图书分门别类地进行编号，并把这些图书的基本信息录入计算机。
③图书借阅：对已入库图书，任课教师可借阅，并进行借阅登记。
④图书归还：对教师归还的图书进行归还登记。
⑧信息查询：即对所有图书的借阅情况， ...
VHDL/FPGA/Verilog 论文基于FPGA的高速实时FFT处理器设计
论文基于FPGA的高速实时FFT处理器设计，给出了详细的设计流程！
编译器/解释器 编译原理（C语言词法分析器的设计与实现） 一．实验目的： 1．强化对系统软件综合工程实现能力、规划能力的训练； 2．加强对词法分析原理、方法和基本实现技术的理解； 二．实验内容： 用C语言(
编译原理（C语言词法分析器的设计与实现）
一．实验目的：
1．强化对系统软件综合工程实现能力、规划能力的训练；
2．加强对词法分析原理、方法和基本实现技术的理解；
二．实验内容：
用C语言(或 C++ )作为宿主语言完成：
C语言(ANSI C或turbo C 2.0)词法分析器的设计和实现。
三、程序简要说明：
1、属性字说明：
2、源程 ...
企业管理 建兴 系列软件《餐饮计算机管理系统》在深入研究酒楼餐饮行业操作规范和业务流程的基础上
建兴 系列软件《餐饮计算机管理系统》在深入研究酒楼餐饮行业操作规范和业务流程的基础上，根据酒楼餐饮行业的实际运作情况而设计，对餐饮业加强内部管理，规范工作人员操作，防止操作中出现人为差错起重要作用。同时提供各类营业报表，使管理者随时了解经营情况和客户的消费情况，及时掌握经营动态。
建兴 系列软件《餐饮 ...
手机WAP编程 这是设计的一个简易手机操作系统
这是设计的一个简易手机操作系统，有详细的工作原理并定义了翔实的工作流程，最后画出了MSC和SDL图
Java编程 毕业设计源玛文档界面 全 图书管理系统毕业设计+源码 目录 前言 第一章 绪论 第一节 设计初衷 第二节 设计任务 第三节 JAVA介绍 第四节 编程运行环境 第
毕业设计源玛\文档\界面 全
图书管理系统毕业设计+源码
目录
前言
第一章 绪论
第一节 设计初衷
第二节 设计任务
第三节 JAVA介绍
第四节 编程运行环境
第五节 系统简介
第二章 系统实现
第一节 系统设计流程
第二节 系统实现过程
第三章 结束语
第四章 附注 ...
VHDL/FPGA/Verilog 本代码介绍了使用VHDL开发FPGA的一般流程
本代码介绍了使用VHDL开发FPGA的一般流程，最终采用了一种基于FPGA的数字频率的实现方法。该设计采用硬件描述语言VHDL