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https://www.eeworm.com/dl/663/137920.html
VHDL/FPGA/Verilog
程序用VHDL实现： 频率合成
程序用VHDL实现：
频率合成，DDS
主要调用LPM
https://www.eeworm.com/dl/668/368566.html
其他行业
合成实验的上位机程序
合成实验的上位机程序，主要用于考核高压断路器开断能力的一种重要方法，也是考核特大容量高压断路器开断能力的唯一可行方法。主要实现数据的采集与存储，和对同步控制装置的参数配置。
https://www.eeworm.com/dl/747759.html
技术资料
数字信号合成技术教程
数字信号合成技术教程，1999年 Copyright 1999 Analog Devices, Inc.DDS的原理、设计、选型等
https://www.eeworm.com/dl/663/170599.html
VHDL/FPGA/Verilog
波形发生器
波形发生器，带TESTBENCH，
多平台
-- the design makes use of the new shift operators available in the VHDL-93 std
-- this design passes the Synplify synthesis check
-- download from: www.fpga.com.cn & www.pld.com.cn