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时钟同步 的查询结果
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VHDL/FPGA/Verilog 合并单元内GPS同步时钟的检测 合并单元内GPS同步时钟的检测
合并单元内GPS同步时钟的检测
合并单元内GPS同步时钟的检测
VHDL/FPGA/Verilog 设计含异步清零和同步时钟使能的加法计数器
设计含异步清零和同步时钟使能的加法计数器
微处理器开发 多时钟域下同步逻辑的RTL代码（包括数据同步器和控制信号万能同步器）
多时钟域下同步逻辑的RTL代码（包括数据同步器和控制信号万能同步器）
VHDL/FPGA/Verilog 一种将异步时钟域转换成同步时钟域的方法
一种将异步时钟域转换成同步时钟域的方法，可节省资源，避免格雷码转换。
Java编程 用FLASH和JAVA制作一个实时同步的时钟
用FLASH和JAVA制作一个实时同步的时钟
uCOS 各个实例显示嵌入式实时操作系统μC/OS-Ⅱ内核的任务管理和调度、系统时钟和节拍服务、时间管理、中断、任务的通信和同步、内存的简单管理原理
各个实例显示嵌入式实时操作系统μC/OS-Ⅱ内核的任务管理和调度、系统时钟和节拍服务、时间管理、中断、任务的通信和同步、内存的简单管理原理，适合初学者入门
VHDL/FPGA/Verilog 很多仪器都输出同步时钟
很多仪器都输出同步时钟，这是一个区毛刺的程序。编得很巧妙！
学术论文 基于FPGA的全同步数字频率计的设计.rar
频率是电子技术领域内的一个基本参数，同时也是一个非常重要的参数。稳定的时钟在高性能电子系统中有着举足轻重的作用，直接决定系统性能的优劣。随着电子技术的发展，测频系统使用时钟的提高，测频技术有了相当大的发展，但不管是何种测频方法，±1个计数误差始终是限制测频精度进一步提高的一个重要因素。 本设计阐述了各 ...
学术论文 基于FPGA的海事卫星突发信号位同步检测研究及实现.rar
码元定时恢复(位同步)技术是数字通信中的关键技术。位同步信号本身的抖动、错位会直接降低通信设备的抗干扰性能，使误码率上升，甚至会使传输遭到完全破坏。尤其对于突发传输系统，快速、精确的定时同步算法是近年来研究的一个焦点。本文就是以Inmarsat GES/AES数据接收系统为背景，研究了突发通信传输模式下的全数字接收机 ...
学术论文 海事卫星突发信号位同步检测
码元定时恢复(位同步)技术是数字通信中的关键技术。位同步信号本身的抖动、错位会直接降低通信设备的抗干扰性能，使误码率上升，甚至会使传输遭到完全破坏。尤其对于突发传输系统，快速、精确的定时同步算法是近年来研究的一个焦点。本文就是以Inmarsat GES/AES数据接收系统为背景，研究了突发通信传输模式下的全数字接收机 ...