搜索结果

找到约 30,919 项符合 数据采集卡 的查询结果

其他 基于Zig Bee协议的温度湿度无线传感器网络 3 辛 颖, 谢光忠, 蒋亚东 (电子科技大学光电信息学院,四川成都610054) 摘 要: 阐述了一种温度湿度智能数据采集的无线传感器网络,介

基于Zig Bee协议的温度湿度无线传感器网络 3 辛 颖, 谢光忠, 蒋亚东 (电子科技大学光电信息学院,四川成都610054) 摘 要: 阐述了一种温度湿度智能数据采集的无线传感器网络,介绍了传感器节点的软件与硬件设计。 该系统基于Zig Bee无线通信协议设计,克服了有线传感器网络的局限性,避免了其他无线通信技术的高 功耗的缺点,节 ...
https://www.eeworm.com/dl/534/400410.html
下载: 25
查看: 1081

驱动编程 以自行开发的基于USB接口的数据采集系统为例

以自行开发的基于USB接口的数据采集系统为例,介绍了USB接口的硬件和软件开发过程。
https://www.eeworm.com/dl/618/402818.html
下载: 198
查看: 1036

单片机开发 1.A/D转换 2.编码器数据采集 3.电机驱动 利用ADC0809芯片

1.A/D转换 2.编码器数据采集 3.电机驱动 利用ADC0809芯片,编码器采用74LS193,idt7205进行增减计数,电机驱动采用8253和L298芯片.
https://www.eeworm.com/dl/648/403480.html
下载: 185
查看: 1070

VHDL/FPGA/Verilog 基于FPGA的B超数据采集功能

基于FPGA的B超数据采集功能,根据输入图像的束同步与帧同步信号,采用中断控制进入FIFO的图像数据的读写操作!
https://www.eeworm.com/dl/663/403665.html
下载: 185
查看: 1059

嵌入式/单片机编程 在许多的数据采集系统中

在许多的数据采集系统中,现场的强电设备较多,不可避免 地会产生尖脉冲干扰,这种干扰一般持续时间短,峰值大,对这样 的数据进行数字滤波处理时,仅仅采用算术平均或移动平均滤波 时,尽管对脉冲干扰进行了1/n的处理,但,其剩余值仍然较大。 这种场合最好的策略是:将被认为是受干扰的信号数据去掉,这 就是防脉冲干 ...
https://www.eeworm.com/dl/647/403683.html
下载: 54
查看: 1074

微处理器开发 项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号

项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号,因此硅微谐振式加速度计数据采集电路完成的主要任务是测出两路频率信号的差值。测量要求是:实现10ms内对中心谐振频率为20kHz、标度因数为100Hz/g、量程为±50g、分辨率为1mg的硅微谐振式加速度计 ...
https://www.eeworm.com/dl/655/404264.html
下载: 58
查看: 1057

串口编程 项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号

项目的研究内容是对硅微谐振式加速度计的数据采集电路开展研究工作。硅微谐振式加速度计敏感结构输出的是两路差分的频率信号,因此硅微谐振式加速度计数据采集电路完成的主要任务是测出两路频率信号的差值。测量要求是:实现10ms内对中心谐振频率为20kHz、标度因数为100Hz/g、量程为±50g、分辨率为1mg的硅微谐振式加速度计 ...
https://www.eeworm.com/dl/624/404265.html
下载: 189
查看: 1062

汇编语言 单片机串行数据采集、传输模块的设计

单片机串行数据采集、传输模块的设计,以GNS97C20051单片机为核心
https://www.eeworm.com/dl/644/404700.html
下载: 51
查看: 1046

单片机开发 本程序介绍了一个利用RS232和/或RS485连接,采用CD4051多选一通道,用TI公司的10位串行A/D芯片TLC1549进行数据采集的程序.本程序还附带AT24C04的读写函数.希望对您有所帮助

本程序介绍了一个利用RS232和/或RS485连接,采用CD4051多选一通道,用TI公司的10位串行A/D芯片TLC1549进行数据采集的程序.本程序还附带AT24C04的读写函数.希望对您有所帮助.
https://www.eeworm.com/dl/648/405010.html
下载: 174
查看: 1190

VHDL/FPGA/Verilog 采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下: 1.系统主时钟为100 MHz。 2.数据为16位-数据线上连续2次00FF后数据传输开始。 3.系统内部总线宽度为8位。

采用VHDL语言设计一个4通道的数据采集控制模块。系统的功能描述如下: 1.系统主时钟为100 MHz。 2.数据为16位-数据线上连续2次00FF后数据传输开始。 3.系统内部总线宽度为8位。 4.共有4个通道(ch1、ch2、ch3、ch4),每个通道配备100 Bytes的RAM,当存满数据后停止数据采集并且相应通道的状态位产生报警信号。 5.数据分为8 ...
https://www.eeworm.com/dl/663/405362.html
下载: 156
查看: 1189