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数字频率合成 的查询结果
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文章/文档 EDA基于VHDL语言的数字频率计的设计及其仿真
EDA基于VHDL语言的数字频率计的设计及其仿真
VHDL/FPGA/Verilog 4位数字频率计的verilog HDL设计
4位数字频率计的verilog HDL设计，精度比较准的
VHDL/FPGA/Verilog 由单片机和CPLD共同构成7位数字频率计
由单片机和CPLD共同构成7位数字频率计
VHDL/FPGA/Verilog 基于FPGA的自适应数字频率计
基于FPGA的自适应数字频率计，测量范围1Hz-99.9MHz
VHDL/FPGA/Verilog 数字频率计是一种用来测试周期性变化信号工作频率的装置。其原理是在规定的单位时间（闸门时间）内
数字频率计是一种用来测试周期性变化信号工作频率的装置。其原理是在规定的单位时间（闸门时间）内，记录输入的脉冲的个数。我们可以通过改变记录脉冲的闸门时间来切换测频量程。本文利用EDA技术中的Max+plusⅡ作为开发工具,设计了基于FPGA的8位十进制频率计,并下载到在系统可编程实验板的EPF10K20TC144-4器件中测试实现了 ...
单片机开发 基于单片机的数字频率计设计
基于单片机的数字频率计设计，定时器T0完成定时功能，T1采用计数功能
VHDL/FPGA/Verilog 8位十进制数字频率计 测量频率范围在1HZ—1MHZ之间
8位十进制数字频率计 测量频率范围在1HZ—1MHZ之间
嵌入式/单片机编程 本程序完整的实现了数字频率计的常用功能。并对通常数字频率计的常见问题进行了改进。具有实用价值。
本程序完整的实现了数字频率计的常用功能。并对通常数字频率计的常见问题进行了改进。具有实用价值。
VHDL/FPGA/Verilog 数字频率计毕业论文 不是自己做的。。哈哈
数字频率计毕业论文 不是自己做的。。哈哈