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数字频率合成 的查询结果
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VHDL/FPGA/Verilog DDs直接数字频率合成器的源代码
DDs直接数字频率合成器的源代码，其中包括采用IP核和普通两种方式
VHDL/FPGA/Verilog 使用vriloge硬件描述语言设计数字频率计
使用vriloge硬件描述语言设计数字频率计，其对于高频测量精确，可测范围0—99999999HZ，在MAX+PLUSII中运行通过并在实验箱上运行通过达到要求
VHDL/FPGA/Verilog 本文用VHDL在CPLD器件上实现一种8 b数字频率计测频系统
本文用VHDL在CPLD器件上实现一种8 b数字频率计测频系统，能够用十进制数码显示被测信号的频率，不仅能够测量正弦波、方波和三角波等信号的频率，而且还能对其他多种物理量进行测量。具有体积小、可靠性高、功耗低的特点。 ...
单片机开发 51单片机开发的等精度数字频率计
51单片机开发的等精度数字频率计，实现计数0-
单片机开发 数字频率合成器DDS9851控制系统的单片机源代码
数字频率合成器DDS9851控制系统的单片机源代码，键盘输入频率，液晶显示，并实时输出所需频率，该系统可选择输出方波和正弦波。
单片机开发 使用3310液晶---数字频率计 .
使用3310液晶---数字频率计
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单片机开发 脉冲发生测试.此程序为AD9850（DDS）直接数字频率合成器C语言源码。用125M的有源晶振
脉冲发生测试.此程序为AD9850（DDS）直接数字频率合成器C语言源码。用125M的有源晶振，频率无失真输出可达到40M。
VHDL/FPGA/Verilog 本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。
本章介绍了两个EDA技术的综合应用设计实例:数字闹钟和直接数字频率合成器DDS。
单片机开发 直接频率合成技术dds
直接频率合成技术dds，开发环境Silicon Laboratories，经测试有用
VHDL/FPGA/Verilog 等精度数字频率计 的一个工程---包括vhdl源程序和编译后产生的相关文件
等精度数字频率计
的一个工程---包括vhdl源程序和编译后产生的相关文件