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其他 下了点关于数字锁相环的东东,下了点关于数字锁相环的东东.

下了点关于数字锁相环的东东,下了点关于数字锁相环的东东.
https://www.eeworm.com/dl/534/248471.html
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RFID编程 数字锁相环实现源码

数字锁相环实现源码,有很大的参考价值。 由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成.
https://www.eeworm.com/dl/697/248679.html
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*行业应用 数字锁相环

数字锁相环,采用costas环的数字形式,实现跟踪载波相位,
https://www.eeworm.com/dl/631/259639.html
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VHDL/FPGA/Verilog 一个实现简单的数字锁相环Verilog代码

一个实现简单的数字锁相环Verilog代码,本人借鉴网上现有的代码后经修改在Cyclone II上调通实现,里面有ModelSim仿真成功的波形图
https://www.eeworm.com/dl/663/276511.html
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系统设计方案 本文在说明全数字锁相环的基础上

本文在说明全数字锁相环的基础上,提出了一种利用FPGA设计一阶全数字锁相环的方法,并 给出了关键部件的RTL可综合代码,并结合本设计的一些仿真波形详细描述了数字锁相环的工作过程,最后对一些有关的问题进行了讨论。
https://www.eeworm.com/dl/678/297682.html
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其他书籍 针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电

针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的 新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利 用仿真波形验证该设计的合理性和有效性。整个设计负载范围宽、锁相时间短,现已成功应用于100 kHz/ 30 kW 的感 ...
https://www.eeworm.com/dl/542/298181.html
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其他 用于时钟恢复的全数字锁相环设计

用于时钟恢复的全数字锁相环设计,可以去掉时钟的抖动。
https://www.eeworm.com/dl/534/299283.html
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VHDL/FPGA/Verilog 一阶全数字锁相环VERLOGIC程序代码

一阶全数字锁相环VERLOGIC程序代码,调试通过。
https://www.eeworm.com/dl/663/309688.html
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其他 介绍了数字锁相环的3种设计方法

介绍了数字锁相环的3种设计方法,并对各自的工作原理做了详细分析。
https://www.eeworm.com/dl/534/309711.html
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VHDL/FPGA/Verilog 微分器:利用数字锁相环进行位同步信号提取的关键模块

微分器:利用数字锁相环进行位同步信号提取的关键模块
https://www.eeworm.com/dl/663/310640.html
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