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数字钟 的查询结果
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VHDL/FPGA/Verilog 数字钟
数字钟，用VHDL写的各个模块，顶层用图形编辑，在实验箱上完全通过
单片机开发 <基于单片机的数字钟设计> 个人做的毕业设计,带Protel图,源代码用proteus软件仿真通过,附有毕设论文
<基于单片机的数字钟设计>
个人做的毕业设计,带Protel图,源代码用proteus软件仿真通过,附有毕设论文
汇编语言 数字钟代码的实现 直接可以使用
数字钟代码的实现
直接可以使用，希望大家分享
VHDL/FPGA/Verilog 数字钟 六位数码管显示
数字钟 六位数码管显示，有清零端，采用分层设计方式编写
教育系统应用 基于matlab实现的可定时数字钟
基于matlab实现的可定时数字钟，带有校时功能，是我们的电子课程设计题目。
汇编语言 万年历数字钟是一种用万年历时钟芯片实现年、月、日、时、分、秒计时
万年历数字钟是一种用万年历时钟芯片实现年、月、日、时、分、秒计时，并通过单片机处理后送给显示芯片显示的装置，与机械式时钟相比具有更高的准确性和直观性，且具有更长的使用寿命。本系统还可以扩展为可调的自动开关,对家电对用电设备进行控制,笔者在随后改制成为可调时的自动断电的供电系统. ...
单片机开发 数字钟C51源程序,51+DS1302+LCD1602,可以使用
数字钟C51源程序,51+DS1302+LCD1602,可以使用
汇编语言 汇编语言实现数字钟功能
汇编语言实现数字钟功能，主要有时间、闹铃、秒表功能，课程设计，写的比较乱，希望耐心看
VHDL/FPGA/Verilog 数字钟的设计
数字钟的设计，有时，分，秒，置数等功能。
其他 数字钟是一个将“时”“分”“秒”显示于人的视觉器官的计时装置。它的计时周期为24小时；显示满刻度为23时59分59秒
数字钟是一个将“时”“分”“秒”显示于人的视觉器官的计时装置。它的计时周期为24小时；显示满刻度为23时59分59秒，另外具备校时功能和报时功能。因此，一个基本的数字钟电路主要由“时”“分”“秒”计数器校时电路组成。将标准秒信号送入“秒计数器”，“秒计数器”采用60进制计数器，每累加60秒发送一个“分脉冲”信号 ...