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VHDL/FPGA/Verilog 数字秒表的设计
数字秒表的设计，reset为归零设置，start为重新计时设置
VHDL/FPGA/Verilog 简易数字钟
简易数字钟，使用VHDL语言编辑，简单设计，容易学习用
数学计算 数字滤波变换
数字滤波变换，其中包括
kfour 傅里叶级数逼近
kkfft 快速傅里叶变换
kkfwt 快速沃什变换
kkspt 快速三次平滑
klman 离散随机系统的卡尔曼滤波
kkabg α-β-γ滤波
VHDL/FPGA/Verilog 数字钟设计
数字钟设计，有分秒显示，上下午显示，可下载到FPGA板子上进行数字显示哦