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https://www.eeworm.com/dl/663/346905.html
VHDL/FPGA/Verilog
FFT程序
FFT程序，此程序虽然耗逻辑资源很大，但是在接受数据后的第7个时钟沿就可以输出FFT变换后的数据，对要求时延较低的系统可以考虑