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异步FIFO 的查询结果
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VHDL/FPGA/Verilog 可综合的FIFO存储器
可综合的FIFO存储器，全部在一个压缩包中，测试过，可以使用．
其他 VHDL设计——FIFO存储器设计
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其他嵌入式/单片机内容 dsp下的异步串行程序,希望对你有用.很有用哦.
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VHDL/FPGA/Verilog VHDL源代码.设计一个带有异步清0功能的十进制计数器。计数器时钟clk上升沿有效
VHDL源代码.设计一个带有异步清0功能的十进制计数器。计数器时钟clk上升沿有效，清零端为clrn,进位输出为co。
数据结构 生产者和消费者的问题,主要解决进程的同步和异步的问题
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编辑器/阅读器 用VHDL语言编的带有异步清零功能的十进制计数器
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串口编程 一个串口通信类的源码. 包括同步和异步
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其他书籍 浙大博士论文：无速度传感器异步电机变频调速与位置伺服控制技术研究
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其他书籍 西南交大硕士论文：基于DSP的异步电机磁场定向控制系统的研究
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系统设计方案 本文介绍了一种EJB异步调用方法,使得客户端能够方便地异步调用EJB
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