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开发工具 Altera ModelSim 6.5仿真入门教程
    Altera ModelSim 6.5仿真入门教程，需要的可自行下载。
平台
软件：ModelSim-Altera 6.5e （Quartus II 10.0） Starter Edition
内容
1 设计流程
使用ModelSim仿真的基本流程为：
     
图1.1 使用 ModelSim仿真的基本流程
2 开始 ...
开发工具 如何仿真IP核(建立modelsim仿真库完整解析)
IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调用了 xilinx 行为模型库的模块 ...
开发工具 用Proteus与Keil整合构建单片机虚拟仿真平台
摘要：单片机学习包括理论与实践学习， 而实践学习所占比例相对较多、 硬件投入大 ，在实践学习中需要大量的实验仪器和设备 在具体的工程实践中 如果因为方案有误而进行相应的开发设计 会浪费较多的时间和经费 一般的单位或个人由于没有较多的经费投入导致实践学习环节比较薄弱 提出一种新的思路 较为全面地阐述采用 ...
开发工具 multisim10.0仿真软件破解版下载
multisim10.0仿真软件破解版下载:【软件介绍】
Multisim本是加拿大图像交互技术公司（Interactive Image Technoligics简称IIT公司)推出的以Windows为基础的仿真工具，被美国NI公司收购后，更名为NI Multisim ，而V10.0是其（即NI，National Instruments）最新推出的Multisim最新版本。
目前美国NI公司的EWB的包含有电 ...
开发工具 multisim10.0仿真软件破解版下载
multisim10.0仿真软件破解版下载:【软件介绍】
Multisim本是加拿大图像交互技术公司（Interactive Image Technoligics简称IIT公司)推出的以Windows为基础的仿真工具，被美国NI公司收购后，更名为NI Multisim ，而V10.0是其（即NI，National Instruments）最新推出的Multisim最新版本。
目前美国NI公司的EWB的包含有电 ...
实用工具 multisim10.0仿真软件破解版下载
multisim10.0仿真软件破解版下载:【软件介绍】
Multisim本是加拿大图像交互技术公司（Interactive Image Technoligics简称IIT公司)推出的以Windows为基础的仿真工具，被美国NI公司收购后，更名为NI Multisim ，而V10.0是其（即NI，National Instruments）最新推出的Multisim最新版本。
目前美国NI公司的EWB的包含有电 ...
可编程逻辑 EDA工程建模及其管理方法研究2
EDA工程建模及其管理方法研究2
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随着微电子技术与计算机技术的日益成熟，电子设计自动化(EDA)技术在电子产品与集成电路
(IC)芯片特别是单片集成(SoC)芯片的设计应用中显得越来越重要。EDA技术采用“自上至下”的设计思想，允许设计人员能够从系统功能级或电路功能级进行产品或芯片的设计，有利于产品在系统功能 ...
仿真技术 基于xPC和CVI的实时仿真系统设计实现
针对在xPC平台下开发的实时仿真系统依赖于MATLAB环境，影响其在工程实践中推广应用的问题，提出了一种基于xPC Target和LabWindows/CVI的实时仿真系统设计方法。采用该方法设计的仿真系统，实现了独立的宿主机程序，同时利用LabWindows/CVI虚拟仪器技术开发出了主控台仿真软件。经仿真验证，该系统具备仿真步长1 ms，数据通 ...
仿真技术 用Proteus与Keil整合构建单片机虚拟仿真平台
摘要：单片机学习包括理论与实践学习， 而实践学习所占比例相对较多、 硬件投入大 ，在实践学习中需要大量的实验仪器和设备 在具体的工程实践中 如果因为方案有误而进行相应的开发设计 会浪费较多的时间和经费 一般的单位或个人由于没有较多的经费投入导致实践学习环节比较薄弱 提出一种新的思路 较为全面地阐述采用 ...
仿真技术 如何仿真IP核(建立modelsim仿真库完整解析)
IP核生成文件：（Xilinx/Altera 同）
IP核生成器生成 ip 后有两个文件对我们比较有用，假设生成了一个 asyn_fifo 的核，则asyn_fifo.veo 给出了例化该核方式（或者在 Edit－》Language Template-》COREGEN 中找到verilog/VHDL 的例化方式）。asyn_fifo.v 是该核的行为模型，主要调用了 xilinx 行为模型库的模块 ...