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https://www.eeworm.com/dl/663/372030.html
VHDL/FPGA/Verilog
采用vhdl语言编程
采用vhdl语言编程，基于quartus平台的三角波仿真。
https://www.eeworm.com/dl/663/466533.html
VHDL/FPGA/Verilog
matlab下
matlab下，用dspbuilder实现dds模块产生正弦波的源码