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小数分频器 的查询结果
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编译器/解释器 一对四分用器的VHDL源码,（输入：D
一对四分用器的VHDL源码,（输入：D ，输出： Y3 Y2 Y1 Y0，另有两个输入控制端S1与S0控制输出选择）
文件格式 介绍8位加法器、分频电路、数字秒表的PPT
介绍8位加法器、分频电路、数字秒表的PPT，带源码，解释详细，一步一步学习，是学习VHDL的好
VHDL/FPGA/Verilog VHDL三分频程序 VHDL三分频程序 VHDL三分频程序
VHDL三分频程序
VHDL三分频程序
VHDL三分频程序
VHDL/FPGA/Verilog 用VHDL语言实现六分频
用VHDL语言实现六分频，并且已经通过编译和仿真。由此可举一反三，实现任意偶数次分频。
系统设计方案 人民币智能分捡器硬件系统设计 人民币智能分捡器硬件系统设计
人民币智能分捡器硬件系统设计 人民币智能分捡器硬件系统设计
VHDL/FPGA/Verilog 一个3分频的VHDL程序,方便学习且仅供学习之用
一个3分频的VHDL程序,方便学习且仅供学习之用
文件格式 自己编写的任意分频VHDL程序
自己编写的任意分频VHDL程序，程序简单，以供大家分享！
多国语言处理 该程序用VHDL硬件描述语言编写而成,已调试通过,程序运行后可实现三分频,这样就用软件设计代替了硬件设计,方便,稳定,不需要硬件调试!
该程序用VHDL硬件描述语言编写而成,已调试通过,程序运行后可实现三分频,这样就用软件设计代替了硬件设计,方便,稳定,不需要硬件调试!
VHDL/FPGA/Verilog 蜂鸣器实验 向蜂鸣器发送一定频率的方波可以使蜂鸣器发出相应的音调
蜂鸣器实验
向蜂鸣器发送一定频率的方波可以使蜂鸣器发出相应的音调，该实验通过设计一个状
态机和分频器使蜂鸣器发出“多来咪发梭拉西多”的音调。
VHDL/FPGA/Verilog VHDL实现任意整数分频
VHDL实现任意整数分频，--只要把n设置成你要分频的数值就可以了