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VHDL/FPGA/Verilog VHDL源码其中“music_rom”使用FPGA厂商提供的工具生成的
VHDL源码其中“music_rom”使用FPGA厂商提供的工具生成的，如Altera的Quartus II 及其宏功能生成的这些文件。
另外，我们还希望实现以下功能：
* 播放音乐时，在ROM的结尾处暂停
* "fullnote"值为0时，表示静音
所以我们将原来的程序的最后一行从 ...
VHDL/FPGA/Verilog 其中“music_rom”使用FPGA厂商提供的工具生成的
其中“music_rom”使用FPGA厂商提供的工具生成的，如Altera的Quartus II 及其宏功能生成的这些文件。
另外，我们还希望实现以下功能：
* 播放音乐时，在ROM的结尾处暂停
所以我们将原来的程序的最后一行从
嵌入式/单片机编程 1)兼容FAT16文件系统
1)兼容FAT16文件系统，长文件名，最大路径长度260个字节,符合Microsoft Longfilename specification。
2)可移植于各种平台，只需编写sector驱动驱动，共计两个函数：1）read_flash_sector() 2）write_flash_sector()。
3)文件缓冲功能：1）读文件时，读位置在文件缓冲区内，则可直接读文件缓冲区，不需要读物理磁盘；文件缓 ...
汇编语言 zip文件下载器的汇编语言源代码
zip文件下载器的汇编语言源代码，运用win32宏汇编。
Java编程 网络设计有编译之后的可执行文件
网络设计有编译之后的可执行文件，Java的可以编译成class文件或者打包成jar文件；
程序可读性强，在必要的宏定义、变量、函数及程序段进行标注
VHDL/FPGA/Verilog 使用Quartus II设计FPGA的应用设计实例  “Example-b3-1uart_regssrc”目录下为设计源文件  “Example-b3-1uart_
使用Quartus II设计FPGA的应用设计实例
&#61548 “\Example-b3-1\uart_regs\src”目录下为设计源文件
&#61548 “\Example-b3-1\uart_regs\core”目录下为Altera的IP宏功能模块
&#61548 “\Example-b3-1\uart_regs\sim\funcsim”目录下为功能仿真文件
&#61548 “\Example-b3-1\uart_regs\sim\parsim”目录下为时序仿真文 ...