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文章/文档 達芬奇DM642 影像處理函數說明文件檔
達芬奇DM642 影像處理函數說明文件檔
VHDL/FPGA/Verilog 在FPGA上实现声卡接口
在FPGA上实现声卡接口，电子琴，滤波比较器，最终实现语音通信
语音压缩 达芬奇DM6446平台音频、视频
达芬奇DM6446平台音频、视频，语音压缩编解码处理演示程序。
DSP编程 TI公司达芬奇DM6446平台最新培训附加实验及实验源码
TI公司达芬奇DM6446平台最新培训附加实验及实验源码，非常值得下载。
VHDL/FPGA/Verilog LDPC码校验节点（checknode）进行奇偶校验方程时的vhdl编程
LDPC码校验节点（checknode）进行奇偶校验方程时的vhdl编程，硬件语言实现
单片机开发 通讯规则: 1:时钟7.3728 MHz/波特率9600/9个数据位/奇校验/1个停止位/硬件多机通讯功能/ 2:通讯连接采用硬件MAX485,双向单工 3:每个上行/下行的数据包的字节个
通讯规则:
1:时钟7.3728 MHz/波特率9600/9个数据位/奇校验/1个停止位/硬件多机通讯功能/
2:通讯连接采用硬件MAX485,双向单工
3:每个上行/下行的数据包的字节个数都是一样的(通讯数据量)
4:每个上行/下行的数据包都采用CRC8校验
5:数据接收采用中断+查询的方式
6:总是由主机向从机发送一个数据包,从机收到数据包后向主 ...
单片机开发 通讯规则: 1:时钟7.3728 MHz/波特率9600/9个数据位/奇校验/1个停止位/硬件多机通讯功能/ 2:通讯连接采用硬件MAX485,双向单工 3:每个上行/下行的数据包的字节个
通讯规则:
1:时钟7.3728 MHz/波特率9600/9个数据位/奇校验/1个停止位/硬件多机通讯功能/
2:通讯连接采用硬件MAX485,双向单工
3:每个上行/下行的数据包的字节个数都是一样的(通讯数据量)
4:每个上行/下行的数据包都采用CRC8校验
5:数据接收采用中断+查询的方式
6:总是由主机向从机发送一个数据包,从机收到数据包后向主 ...
嵌入式Linux 2410开发板上的声卡驱动！网上收集！很全的啊！1341型号
2410开发板上的声卡驱动！网上收集！很全的啊！1341型号
企业管理 网奇CWMS企业网站管理系统 Company Website Manage System 采用微软 ASP.NET2.0(C#) 设计
网奇CWMS企业网站管理系统 Company Website Manage System
采用微软 ASP.NET2.0(C#) 设计，使用分层设计模式，页面高速缓存，是迄今为止国内最先进的.NET语言企业网站管理系统。整套系统的设计构造，完全考虑大中小企业类网站的功能要求，网站的后台功能强大，管理简捷，支持模板机制。使用国际编码，通过xml配置语言，一 ...