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VHDL/FPGA/Verilog verilog描述 年月日
verilog描述
年月日,小时分秒的显示,2000~2099年的万历年循环
用set控制,设置状态,按一下改变一个设置,正常显示时,按set进入小时设置,依次是分钟,年,月,天(天设置带懂周变换)
在设置状态,按一下ADJ,加一下,按cf就减1,同步修改显示;设置状态下,按mode键或是60秒无按键,推出设置状态,返回正常显示
正常显 ...
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