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VHDL/FPGA/Verilog
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verilog描述 年月日
verilog描述 年月日
VHDL/FPGA/Verilog
5 K
30 次下载
2016-05-30
资源详细信息
文件格式
压缩包
文件大小
5 K
资源分类
VHDL/FPGA/Verilog
上传者
fansino
发布时间
2016-05-30 10:37
下载统计
30
次
所需积分
2 积分
verilog描述 年月日 - 资源详细说明
verilog描述 年月日,小时分秒的显示,2000~2099年的万历年循环 用set控制,设置状态,按一下改变一个设置,正常显示时,按set进入小时设置,依次是分钟,年,月,天(天设置带懂周变换) 在设置状态,按一下ADJ,加一下,按cf就减1,同步修改显示;设置状态下,按mode键或是60秒无按键,推出设置状态,返回正常显示 正常显示是,按ADJ,进行24,12小时显示切换,带AM_PM显示
verilog描述 年月日 - 源码文件列表
本资源包含 1 个源码文件
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1
time_run.v
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