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其他 对ofdm插入梳妆(comb)导频

对ofdm插入梳妆(comb)导频,比较了有ls信道估计和无信道估计,并仿真得到了不同信噪比下,误码率曲线;信道为多径瑞利衰落加上白噪声;经过调试,已经能正确运行
https://www.eeworm.com/dl/534/297010.html
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通讯/手机编程 ofdm仿真程序有关信道传输中的多径效应

ofdm仿真程序有关信道传输中的多径效应,多普勒频移,时延扩展
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VHDL/FPGA/Verilog 分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL

分频器是FPGA设计中使用频率非常高的基本单元之一。尽管目前在大部分设计中还广泛使用集成锁相环(如altera的PLL,Xilinx的DLL)来进行时钟的分频、倍频以及相移设计,但是,对于时钟要求不太严格的设计,通过自主设计进行时钟分频的实现方法仍然非常流行。首先这种方法可以节省锁相环资源,再者,这种方式只消耗不多的逻辑单 ...
https://www.eeworm.com/dl/663/308242.html
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VHDL/FPGA/Verilog 数字测频器

数字测频器,多信号测频,和标准频率比对 输出采样信号
https://www.eeworm.com/dl/663/313090.html
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VHDL/FPGA/Verilog vhdl3分频功能看名字就知道了

vhdl3分频功能看名字就知道了,还用多说什么吗,大家都是聪明人
https://www.eeworm.com/dl/663/314147.html
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VHDL/FPGA/Verilog 本文件包括多路选择器器建模

本文件包括多路选择器器建模,译码器实验程序,加法器实验程序,比较器实验程序,计数器建模,I2C接口标准建模源码,串行接口RS232标准建模源码标准,LCM建模源码,时钟6分频源码,串并转化源码。 ,对于硬件设计初学者来说有一定的参考价值。 ...
https://www.eeworm.com/dl/663/318858.html
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VHDL/FPGA/Verilog 四位计数器 计数器是数字系统中用得较多的基本逻辑器件。它不仅能记录输入时钟脉冲的个数

四位计数器 计数器是数字系统中用得较多的基本逻辑器件。它不仅能记录输入时钟脉冲的个数,还可以实现分频、定时、产生节拍脉冲和脉冲序列等。例如,计算机中的时序发生器、分频器、指令计数器等都要使用计数器。
https://www.eeworm.com/dl/663/320953.html
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驱动编程 基于FDMA背景下的斜投影算子区分多用户信息

基于FDMA背景下的斜投影算子区分多用户信息,用户载频空间构成斜投影算子。
https://www.eeworm.com/dl/618/322610.html
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matlab例程 本程序包括直接序列扩频

本程序包括直接序列扩频,跳频扩频和跳频多址的相关程序
https://www.eeworm.com/dl/665/330169.html
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技术管理 :高速混合PCB 的电磁兼容性设计首要解决合理安排布局布线和接地问题。分析基频和高频谐波、信号上 升或下降速率

:高速混合PCB 的电磁兼容性设计首要解决合理安排布局布线和接地问题。分析基频和高频谐波、信号上 升或下降速率,电路的等效分布参数,传导耦合、辐射耦合和不匹配线的辐射、串音干扰等。根据板层、电源平面、 时钟电路和高频电路的布线原则进行布局布线。接地选择单点或多点接地。 ...
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