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教程资料 基于FPGA的视频图像画面分割器的设计

  系统结构如 图 1所示 , 从 系统 结 构图可 以看 出 , 系统主要包括视频信 号输入模块 , 视频信号处 理模 块和视频信号输出模块等 3个部分组成。各个模块主要功能为: 视频输入模块 将 采 集 的 多路 视 频 信 号 转 换成 数 字 信 号 送 到F P GA; 视频处理模块主要有F P GA 完成 ,根据 需要 对输入 的数字视频 ...
https://www.eeworm.com/dl/fpga/doc/32273.html
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教程资料 基于FPGA的高速电路设计与仿真

现代数字信号处理从视频扩展到了中频甚至射频,针对要求信号处理的处理速度越来越高、传输速率越来越快等特点,给出了一款使用高性能FPGA、DAC以及经先进的PCB设计工具设计、仿真的高速信号处理模块,实现了对高速信号的实时接收和处理。关键词:数字信号处理; 高速电路; FPGA;设计与仿真 ...
https://www.eeworm.com/dl/fpga/doc/32700.html
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教程资料 基于FPGA 的单精度浮点数乘法器设计

设计了一个基于FPGA的单精度浮点数乘法器.设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构,并提出对Wallace树产生的2个伪和采用部分相加的方式,提高了乘法器的运算速度;加入对特殊值的处理模块,完善了乘法器的功能.本设计在Altera DE2开发板上进行了验证. ...
https://www.eeworm.com/dl/fpga/doc/32711.html
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通信网络 基于三网融合的数字家庭媒体中心设计

  设计了一款基于三网融合的数字家庭媒体中心。采用SMP8644 做高清解码与系统控制,配备UTI 机卡分离的有线数字电视(DVB-C)接收模块、e 家佳家庭子网控制模块、CBHD 蓝光光头机芯和前端处理模块以及一些外围接口,通过SATA 接口可内置或外挂大容量硬盘,通过10/100 Mbit/s 以太网卡和WiFi 无线网卡,可以上网连 ...
https://www.eeworm.com/dl/564/33797.html
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嵌入式综合 嵌入式数字存储示波器设计

提出了一种基于FPGA和STM32的嵌入式数字存储示波器设计,以STM32为控制核心,FPGA作为数据采集和处理模块,完成了对外部信号的采集和传输,实现了存储示波器数据处理和显示的功能。
https://www.eeworm.com/dl/566/34927.html
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嵌入式综合 基于Nios II的双网传真机系统的研究与开发

基于Nios-II设计和实现了支持PSTN网络、Internet网络的双网传真机系统,利用FPGA实现了传真机系统的多个电路模块,包括A/D采样控制逻辑、二值化图像处理模块、MH编码模块、MH译码模块和CIS扫描、TPH打印、电机控制模块。基于μC/OS-II、Niche TCP/IP实现了T30协议通信、非实时网络传真通信、Tiff文件创建、Tiff文件解析模块 ...
https://www.eeworm.com/dl/566/35948.html
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无线通信 基于Windows Mobile的个人移动导航系统

借鉴现有导航产品优点,结合GPS、GIS以及嵌入式开发技术,开发了个人移动导航系统。导航系统以微软的Windows Mobile 6.5为操作系统,采用ST-92 GPS模块接收GPS数据。软件开发采用Visual Studio 2005开发环境,嵌入Mapx Mobile组件,通过RS232接口接收并处理模块数据,实现了实时定位、路径记录等功能。对地图匹配算法进行了 ...
https://www.eeworm.com/dl/510/35988.html
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无线通信 GNSS软件接收机的框架结构及原型系统开发

介绍全球导航卫星系统软件接收机的基本结构和优点,系统地实现了GPS软件接收机。该结构的硬件部分实现中频信号采样模块,软件部分实现可设置12通道的中频信号处理模块、信号捕获和跟踪、导航电文存储及转换,并针对伪距定位算法部分实现了单点静态定位,考虑的误差源主要包括卫星钟误差、对流层误差、电离层误差和地球自转 ...
https://www.eeworm.com/dl/510/36254.html
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可编程逻辑 基于FPGA的视频图像画面分割器的设计

  系统结构如 图 1所示 , 从 系统 结 构图可 以看 出 , 系统主要包括视频信 号输入模块 , 视频信号处 理模 块和视频信号输出模块等 3个部分组成。各个模块主要功能为: 视频输入模块 将 采 集 的 多路 视 频 信 号 转 换成 数 字 信 号 送 到F P GA; 视频处理模块主要有F P GA 完成 ,根据 需要 对输入 的数字视频 ...
https://www.eeworm.com/dl/kbcluoji/39286.html
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可编程逻辑 基于FPGA 的单精度浮点数乘法器设计

设计了一个基于FPGA的单精度浮点数乘法器.设计中采用改进的带偏移量的冗余Booth3算法和跳跃式Wallace树型结构,并提出对Wallace树产生的2个伪和采用部分相加的方式,提高了乘法器的运算速度;加入对特殊值的处理模块,完善了乘法器的功能.本设计在Altera DE2开发板上进行了验证. ...
https://www.eeworm.com/dl/kbcluoji/40361.html
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