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教程资料  基于FPGA的多功能数字钟的设计与实现内附有详尽的Verilog HDL源码

基于FPGA的多功能数字钟的设计与实现内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等

https://www.eeworm.com/dl/fpga/doc/18055.html

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教程资料  s3c2410开发板cpld源码

s3c2410开发板cpld源码，希望有些参考价值

https://www.eeworm.com/dl/Protel/doc/18124.html

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教程资料  FPGA RSIC CPU设计文档和源码是EDA中对CPU设计非常好用的程序

FPGA RSIC CPU设计文档和源码是EDA中对CPU设计非常好用的程序

https://www.eeworm.com/dl/fpga/doc/18187.html

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教程资料  通过fpga产生时钟的VHDL源码

通过fpga产生时钟的VHDL源码，QII7.1下调试通过

https://www.eeworm.com/dl/fpga/doc/18295.html

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教程资料  ACTEL A3P StartKit FPGA开发全套文挡（含测试源码）

ACTEL A3P StartKit FPGA开发全套文挡（含测试源码）

https://www.eeworm.com/dl/fpga/doc/18421.html

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教程资料  FPGA数字电子系统设计与开发实例导航光盘内附源码

FPGA数字电子系统设计与开发实例导航光盘内附源码

https://www.eeworm.com/dl/fpga/doc/18422.html

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教程资料  基于FPGA＋DDS的MSK数字调制源设计

基于FPGA＋DDS的MSK数字调制源设计通信中的DDS技术应用

https://www.eeworm.com/dl/fpga/doc/18452.html

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教程资料  采用FPGA模拟高动态GPS信号源中的C／A码产生器

本文：采用了FPGA方法来模拟高动态(Global Position System GPS)信号源中的C／A码产生器。C／A码在GPS中实现分址、卫星信号粗捕和精码(P码)引导捕获起着重要的作用，通过硬件描述语言VERILOG在ISE中实现电路生成，采用MODELSIM、SYNPLIFY工具分别进行仿真和综合。 ...

https://www.eeworm.com/dl/fpga/doc/18520.html

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教程资料  fpga实现CAN总线控制器源码(含详细说明)

fpga实现ＣＡＮ总线控制器源码,每个项目都有说明文件，介绍使用方法。

https://www.eeworm.com/dl/fpga/doc/18532.html

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教程资料  实现音乐播放的FPGA的实验源码（Verilog语言）

这是一个FPGA的实验源码，可以实现对一段音乐的播放。用Verilog语言编写的，对初学者会有一定的帮助。

https://www.eeworm.com/dl/fpga/doc/18550.html

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