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VHDL/FPGA/Verilog 主要是通过Altera公司的Cuclone系列的FPGA-EP1C3T144C8产生余弦波的源代码 基于LPM-ROM余弦波一周期含有256个10位数据；
主要是通过Altera公司的Cuclone系列的FPGA-EP1C3T144C8产生余弦波的源代码 基于LPM-ROM余弦波一周期含有256个10位数据；
网络 对posix timer面向对象的封装。 进程内部每一个timer都可以拥有自己的timeout回调函数。 提供周期性timer和一次性timer。 对其进行面向对象封装。
对posix timer面向对象的封装。
进程内部每一个timer都可以拥有自己的timeout回调函数。
提供周期性timer和一次性timer。
对其进行面向对象封装。
单片机开发 自己的小作,用于前后台系统,时间任务的管理,可以将运行周期和运行目标程序动态建立,销毁,还可以指定程序的运行次数,如运行3次后自动销毁,类似操作系统的管理模式.
自己的小作,用于前后台系统,时间任务的管理,可以将运行周期和运行目标程序动态建立,销毁,还可以指定程序的运行次数,如运行3次后自动销毁,类似操作系统的管理模式.
其他 基于IR1150的单周期控制PFC的原理与设计 无信号源的自激式激磁电源的设计 基于dsPIC30F2010控制光伏水泵变频器的研究 陀螺供电电源设计
基于IR1150的单周期控制PFC的原理与设计
无信号源的自激式激磁电源的设计
基于dsPIC30F2010控制光伏水泵变频器的研究
陀螺供电电源设计
其他 高性能、低功耗的 AVR® 8 位微处理器 • 先进的 RISC 结构 – 133 条指令 – 大多数可以在一个时钟周期内完成 – 32 x 8 通用工作寄存器 + 外设控制寄存
高性能、低功耗的 AVR® 8 位微处理器
• 先进的 RISC 结构
– 133 条指令 – 大多数可以在一个时钟周期内完成
– 32 x 8 通用工作寄存器 + 外设控制寄存器
– 全静态工作
– 工作于16 MHz 时性能高达16 MIPS
汇编语言 TLC5620 DAC转换实验程序 该实验程序使用TLC5620中A、B、C、D四个通道中的前两个通道分别输出周期相等、幅度均为3.3V的三角波和方波
TLC5620 DAC转换实验程序
该实验程序使用TLC5620中A、B、C、D四个通道中的前两个通道分别输出周期相等、幅度均为3.3V的三角波和方波，5620的输出经过LM358双运方的反相跟随后增强了带负载能力
并且使得输出的信号电压位于-3.3V～0V之间，起到了模拟反相的作用。在程序中，RNG位的置位使得输出幅度增加一倍。 ...
VHDL/FPGA/Verilog EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器 --- 发送器每隔16 个CLK16 时钟周期输出1 位
EDA实验--UART串口实验：UART 主要有由数据总线接口、控制逻辑、波特率发生器、发送部分和接收部分等组成。UART 发送器
--- 发送器每隔16 个CLK16 时钟周期输出1 位，次序遵循1位起始位、8位数据位（假定数据位为8位）、1位校验位（可选）、1位停止位。
UART 接收器
--- 串行数据帧和接收时钟是异步的，发送来的数据由逻 ...
软件工程 CMMI® (能力成熟Model® 综合化)是一个步骤改进成熟模型为产品和服务的发展。 它包括地址发展和维护活动通过交付和维护包括产品的生命周期从构想的最佳的实践。
CMMI® (能力成熟Model® 综合化)是一个步骤改进成熟模型为产品和服务的发展。 它包括地址发展和维护活动通过交付和维护包括产品的生命周期从构想的最佳的实践。
其他 1． 利用自相关函数法和周期图法实现随机信号的功率谱估计。 2． 观察数据长度、自相关序列长度、信噪比、窗函数、平均次数等对谱估计的分辨率、稳定性、主瓣宽度和旁瓣效应的影响。
1． 利用自相关函数法和周期图法实现随机信号的功率谱估计。
2． 观察数据长度、自相关序列长度、信噪比、窗函数、平均次数等对谱估计的分辨率、稳定性、主瓣宽度和旁瓣效应的影响。