搜索结果
找到约 13,637 项符合
同步电路 的查询结果
按分类筛选
- 全部分类
- 学术论文 (120)
- 技术资料 (62)
- 单片机编程 (28)
- VIP专区 (20)
- VHDL/FPGA/Verilog (11)
- 可编程逻辑 (9)
- 模拟电子 (7)
- 电源技术 (7)
- 单片机开发 (7)
- 其他书籍 (5)
- 教程资料 (4)
- 技术书籍 (3)
- 嵌入式/单片机编程 (3)
- 其他 (3)
- PCB相关 (2)
- 嵌入式综合 (2)
- 开发工具 (2)
- 测试测量 (2)
- RFID编程 (2)
- matlab例程 (2)
- 系统设计方案 (2)
- 经验分享 (1)
- 电机控制 (1)
- Mentor (1)
- DSP编程 (1)
- 传感与控制 (1)
- 无线通信 (1)
- C/C++语言编程 (1)
- 实用工具 (1)
- 接口技术 (1)
- EDA相关 (1)
- 通讯编程文档 (1)
- 微处理器开发 (1)
- 汇编语言 (1)
- 数据结构 (1)
- 文件格式 (1)
- VC书籍 (1)
- 串口编程 (1)
- 中间件编程 (1)
- 电子技术 (1)
- 设计相关 (1)
- 教材/考试/认证 (1)
- 电子大赛 (1)
- 论文 (1)
- 书籍 (1)
- 应用设计 (1)
- 电路图 (1)
学术论文 1V30A输出应用新型同步整流驱动方案的正反激电路的研究.rar
随着数字集成电路技术的不断发展,数字集成电路的供电电源-电压调节模块(VRM)也有了新的发展趋势:输出功率越来越大、输出电压越来越低、输出电流越来越大。因此,对低输出电压、大输出电流的VRM及其相关技术的研究在最近几年受到广泛的关注。 本文以36V-72V输入、1V/30A输出的VRM为研究对象,对VRM电路拓扑进行分类和比 ...
电源技术 与电网电压同步的正弦波发生电路设计
目前的有源电力滤波器通常是采用基于瞬时无功功率理论的谐波电流检测方法。其中的ip-iq算法需要用到与电网电压同步的正余弦信号,即与电网电压同频同相的标准正余弦信号。该信号的获取可以采用锁相环加正余弦函数发生器的方法,也可采用软件查表的方法。本设计采用全硬件电路完成,即通过锁相环加正弦函数发生器的方法,可 ...
单片机编程 pic18fxx8单片机通用同步异步收发器的接口电路和c源代码
pic18fxx8单片机通用同步异步收发器的接口电路和c源代码
VHDL/FPGA/Verilog 同步串行数据发送电路SSDT的基本功能是将并行数据转换成串行数据并进行同步发送。系统写入和读出时序完全兼容Intel8086时序。 系统以同步信号开始连续发送四个字节
同步串行数据发送电路SSDT的基本功能是将并行数据转换成串行数据并进行同步发送。系统写入和读出时序完全兼容Intel8086时序。
系统以同步信号开始连续发送四个字节,在发送中出现5个1时插入一个0,在四个数据发送结束而下一次同步没有开始之前,发送7FH,这时中间不需要插入零 ...
VHDL/FPGA/Verilog 同步串行数据发送电路SSDT的基本功能是将并行数据转换成串行数据并进行同步发送。系统写入和读出时序完全兼容Intel8086时序。 系统以同步信号开始连续发送四个字节
同步串行数据发送电路SSDT的基本功能是将并行数据转换成串行数据并进行同步发送。系统写入和读出时序完全兼容Intel8086时序。
系统以同步信号开始连续发送四个字节,在发送中出现5个1时插入一个0,在四个数据发送结束而下一次同步没有开始之前,发送7FH,这时中间不需要插入零 ...
其他书籍 一本关于复位说明的很好的文章。上面详细的介绍了同步复位和异步复位的区别。和应用。对于电路设计的人很有用
一本关于复位说明的很好的文章。上面详细的介绍了同步复位和异步复位的区别。和应用。对于电路设计的人很有用
微处理器开发 同步及异步时序电路fifo源程序及其测试程序.rar - fifo源程序
同步及异步时序电路fifo源程序及其测试程序.rar - fifo源程序,erilog编写~具有较强的参考价值~
其他书籍 包含内容有1.逻辑代数基础 2逻辑函数的表示方式和化简 3中规模集成电路的分析和设计 4触发器及其简单应用电路 5同步时序电路的分析和设计 6常见的同步集成时序电路 7异步时序电路的分析和
包含内容有1.逻辑代数基础
2逻辑函数的表示方式和化简
3中规模集成电路的分析和设计
4触发器及其简单应用电路
5同步时序电路的分析和设计
6常见的同步集成时序电路
7异步时序电路的分析和设计
8数字逻辑技术的最新发展
是我们大学老师(这方面的专家)数字逻辑的课件,非常不错 ...
RFID编程 DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成. 整个系统的中心频率(即signal_in和signal_out的码速率的2倍) 为clk/8/N. 模K
DPLL由 鉴相器 模K加减计数器 脉冲加减电路 同步建立侦察电路 模N分频器 构成.
整个系统的中心频率(即signal_in和signal_out的码速率的2倍)
为clk/8/N. 模K加减计数器的K值决定DPLL的精度和同步建立时间,K越大,则同步建立时间长,同步精度高.反之则短,低. ...
嵌入式/单片机编程 音乐发生器及同步显歌词本试验从硬件电路原理图
音乐发生器及同步显歌词本试验从硬件电路原理图,PCB图,元器件布线图的设计,元器件的安装与硬件调试,到软件控制程序设计,再到系统软件硬件联调,进行全过程分析和实验