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https://www.eeworm.com/dl/502489.html
VHDL/FPGA/Verilog
FPGA的多路可控脉冲延迟系统.docx
1  系统功能
本系统拟定对频率范围在1~50 kHz左右的TTL电平脉冲序列进行多路延迟处理。各路延迟时间分别由单片机动态设定，最大延迟时间为1 ms，最大分辨率为0.15 ns级。
3  方案实现
系统选用Actel公司的ProASIC3 A3P250芯片实现数字部分。系统时钟由外部50 MHz晶 ...