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VHDL/FPGA/Verilog 用Verilog语言实现信号发生器

用Verilog语言实现信号发生器，包括AM，FM,PM，ASK,PSK,FSK调制。

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VHDL/FPGA/Verilog 数字移相信号发生器设计

数字移相信号发生器设计，采用quartus2平台

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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.1 简单的可编程单脉冲发生器　　9.1.1 由系统功能描述时序关系　　9.1.2 流程图的设计　　9.1.3 系统功能描述　　

基于Verilog-HDL的硬件电路的实现 9.1 简单的可编程单脉冲发生器　　9.1.1 由系统功能描述时序关系　　9.1.2 流程图的设计　　9.1.3 系统功能描述　　9.1.4 逻辑框图　　9.1.5 延时模块的详细描述及仿真　　9.1.6 功能模块Verilog-HDL描述的模块化方法　　9.1.7 输入检测模块的详细描述及仿真　　9.1.8 计 ...

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VHDL/FPGA/Verilog 基于Verilog-HDL的硬件电路的实现 9.2 具有LCD显示单元的可编程单脉冲发生器　　9.2.1 LCD显示单元的工作原理　　9.2.2 显示逻辑设计的思路与流程　　9.

基于Verilog-HDL的硬件电路的实现 9.2 具有LCD显示单元的可编程单脉冲发生器　　9.2.1 LCD显示单元的工作原理　　9.2.2 显示逻辑设计的思路与流程　　9.2.3 LCD显示单元的硬件实现　　9.2.4 可编程单脉冲数据的BCD码化　　9.2.5 task的使用方法　　9.2.6 for循环语句的使用方法　　9.2.7 二进制数转换BCD码 ...

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汇编语言  实验24-脉冲信号发生器实验参考程序,基于PIC16F877A

实验24-脉冲信号发生器实验参考程序,基于PIC16F877A

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DSP编程  DSP中利用ccs5000编程包括sinx计算FIR滤波正弦波发生器等

DSP中利用ccs5000编程包括sinx计算FIR滤波正弦波发生器等

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DSP编程  基于dsp的信号发生器程序源代码

基于dsp的信号发生器程序源代码，在CCS环境下使用

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VHDL/FPGA/Verilog 设计一个能够自启动的24-1的伪随机码（111101011001000）发生器。设计一个序列信号发生器

设计一个能够自启动的24-1的伪随机码（111101011001000）发生器。设计一个序列信号发生器，产生一个011100110011序列码。实现序列1110100。测试序列码波形个人比较欣赏第二种方法

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DSP编程  dsp实验测试程序,包括指令实验、存储器、串口、同步串口、步进电机、硬件中断、定时器、交通灯、直流电机、滤波器、正弦波发生器、语音录放、EXAM_C、显示屏

dsp实验测试程序,包括指令实验、存储器、串口、同步串口、步进电机、硬件中断、定时器、交通灯、直流电机、滤波器、正弦波发生器、语音录放、EXAM_C、显示屏

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单片机开发  本程序介绍单片机作为信号发生器

本程序介绍单片机作为信号发生器，来产生不同频率的正弦波、矩形波等。

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