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学术论文 基于DSP的高精度多路数据采集系统的设计
· 摘要： 讨论了DSP芯片TMS320F2812和AD转换芯片AD7856的特点,设计了具有较高精度的基于AD7856和DSP的32路数据采集系统.给出了AD7856和DSP的接口电路以及DSP与上位机之间数据通讯的实现方式.
uCOS 使用多任务
使用多任务，每个任务监视一路AD 转换，每一路AD 转换的结果在触摸屏上用一个波表来表示，直观地显示每路AD 的结果。可以通过文本框给每路AD 设置警戒值，超出警戒之后超出的部分会以闪动的方式显示。
技术资料 基于DSP的高精度多路数据采集系统的设计
· 摘要： 讨论了DSP芯片TMS320F2812和AD转换芯片AD7856的特点,设计了具有较高精度的基于AD7856和DSP的32路数据采集系统.给出了AD7856和DSP的接口电路以及DSP与上位机之间数据通讯的实现方式.
matlab例程 AC-DC-AC双pwm逆变器的Matlab/Simulink仿真源程序。包括两个电路：一个是50Hz三相 AC(PWM整流)->DC->50Hz三相AC(PWM逆变),驱动三相对称电阻负
AC-DC-AC双pwm逆变器的Matlab/Simulink仿真源程序。包括两个电路：一个是50Hz三相 AC(PWM整流)->DC->50Hz三相AC(PWM逆变),驱动三相对称电阻负载；一个是60Hz 三相AC(全波整流)->DC->50Hz三相AC（PWM逆变），驱动一个永磁同步电动机。（本源码基于王军(xiaohongchen@163.com)上载的double_pwm_inverter.mdl改进而来，适用于m ...
嵌入式/单片机编程 FIFO（先进先出队列）通常用于数据的缓存和用于容纳异步信号的频率或相位的差异。本FIFO的实现是利用 双口RAM 和读写地址产生模块来实现的.FIFO的接口信号包括异步的写时钟（wr_clk）和读
FIFO（先进先出队列）通常用于数据的缓存和用于容纳异步信号的频率或相位的差异。本FIFO的实现是利用
双口RAM 和读写地址产生模块来实现的.FIFO的接口信号包括异步的写时钟（wr_clk）和读时钟（rd_clk）、
与写时钟同步的写有效（wren）和写数据（wr_data） 、与读时钟同步的读有效（rden）和读数据（rd_data）
为了实现正 ...
数据库系统 该项目为双用户：管理员 与营业员 角色登陆显示不同信息 今日房价：可以点双击房价进行在线修改 开房记录报表只供查询（关键字：开房/退房 时间或者日期或者描述信息） 房间信息管理：可以直接点击
该项目为双用户：管理员 与营业员 角色登陆显示不同信息
今日房价：可以点双击房价进行在线修改
开房记录报表只供查询（关键字：开房/退房 时间或者日期或者描述信息）
房间信息管理：可以直接点击grid面板编辑 房间类型是单击时从数据库读出
首页放了几张图片用的是jquery的一个图片插件
左侧面板公告信息是自己胡乱修改 ...
VHDL/FPGA/Verilog 异步FIFO是用来适配不同时钟域之间的相位差和频率飘移的重要模块。本文设计的异步FIFO采用了格雷（GRAY）变换技术和双端口RAM实现了不同时钟域之间的数据无损传输。该结构利用了GRAY变换的特点
异步FIFO是用来适配不同时钟域之间的相位差和频率飘移的重要模块。本文设计的异步FIFO采用了格雷（GRAY）变换技术和双端口RAM实现了不同时钟域之间的数据无损传输。该结构利用了GRAY变换的特点，使得整个系统可靠性高和抗干扰能力强，系统可以工作在读写时钟频率漂移达到正负300PPM的恶劣环境。并且由于采用了模块化结构， ...