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VHDL/FPGA/Verilog verilog实现的奇数分频器 针对任何规模的奇数分频
verilog实现的奇数分频器 针对任何规模的奇数分频
其他 十二音阶和八度分频的硬件描述语言VHDL程序
十二音阶和八度分频的硬件描述语言VHDL程序，测试通过成功
VHDL/FPGA/Verilog 分别用分频比交错法及累加器分频法完成非整数分频器设计。
分别用分频比交错法及累加器分频法完成非整数分频器设计。
VHDL/FPGA/Verilog 电子琴VHDL程序包含有：顶层程序、音阶发生器程序、数控分频模块程序和自动演奏模块程序。
电子琴VHDL程序包含有：顶层程序、音阶发生器程序、数控分频模块程序和自动演奏模块程序。
VHDL/FPGA/Verilog 一个任意整数分频程序,采用VHDL语言编写
一个任意整数分频程序,采用VHDL语言编写，编译通过
VHDL/FPGA/Verilog 使用VHDL语言产生4M分频
使用VHDL语言产生4M分频，用于描述硬件功能
VHDL/FPGA/Verilog 这是一个8分频的VHDL语言设计程序
这是一个8分频的VHDL语言设计程序，也可以看成是8进制计数器
VHDL/FPGA/Verilog 用FPGA仿真实现数控分频器
用FPGA仿真实现数控分频器，完整的工程文件
VHDL/FPGA/Verilog 利用FPGA进行分频期的设计
利用FPGA进行分频期的设计，包括小数，分数等分频
其他 此文件为EDA的8位分频器
此文件为EDA的8位分频器，但可以用于不同位分频器，如：1位到10位等，用Quartus软件来，以文件VHD格式编译即可