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https://www.eeworm.com/dl/663/361490.html VHDL/FPGA/Verilog

这是用Verilog HDL写的可调占空比分频控制器

这是用Verilog HDL写的可调占空比分频控制器，可以挂在Avalon总线上使用
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https://www.eeworm.com/dl/663/367024.html VHDL/FPGA/Verilog

此程序是用硬件描述语言VHDL编写的分频程序

此程序是用硬件描述语言VHDL编写的分频程序，实现了不同的频率输入。
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https://www.eeworm.com/dl/641/384489.html 数学计算

基2分频与基于分裂基的fft的实现

基2分频与基于分裂基的fft的实现，特别是新型的倒序算法提高了程序的质量
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https://www.eeworm.com/dl/663/442124.html VHDL/FPGA/Verilog

一种实现任意整数分频的ＶＨＤＬ源代码

一种实现任意整数分频的ＶＨＤＬ源代码，已经经过调试
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https://www.eeworm.com/dl/921563.html 技术资料

4060 CMOS 14级二进制计数、分频、振荡器

The CD4020BC, CD4060BC are 14-stage ripple carrybinary counters, and the CD4040BC is a 12-sta
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https://www.eeworm.com/dl/571/20581.html 模拟电子

怎样使用D触发器实现二分频器

D触发器实现二分频器
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https://www.eeworm.com/dl/648/164275.html 单片机开发

采用C语言来编辑分频 测控 计数和储存。和硬件相匹配

采用C语言来编辑分频 测控 计数和储存。和硬件相匹配，用单片机来实现的FM调制器
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https://www.eeworm.com/dl/663/171561.html VHDL/FPGA/Verilog

利用VHDL语言编写的一个16分频器

利用VHDL语言编写的一个16分频器，另外可以在程序中修改为任意2N的分频器
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https://www.eeworm.com/dl/654/268480.html 数据结构

了解减法分频电路的设计。 （2）内容：分析例2.8程序的原理

了解减法分频电路的设计。 （2）内容：分析例2.8程序的原理，给出其仿真结果，说明语句的功能。可以改变程序中的分频比。引脚锁定可参考图2.9。 （3）说明：将CLK2的跳线冒连在2Hz上 。LED1指示输入频率，LED2分频后的结果。可以看到LED1每闪烁6下，LED2闪烁一下，因为是6分频电路。 ...
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https://www.eeworm.com/dl/534/293614.html 其他

能够实现0~99的任意分频,并实现输出频率50％的占空比

能够实现0~99的任意分频,并实现输出频率50％的占空比
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