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教程资料 详细描述了在FPGA/CPLD设计过程中应注意的地方和如何提高设计效率

详细描述了在FPGA/CPLD设计过程中应注意的地方,和如何提高设计效率,对FPGA设计者有很好的帮助
https://www.eeworm.com/dl/fpga/doc/18450.html
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教程资料 DDS技术应用于FPGA实现正弦波（周期信号）的产生

DDS技术应用于FPGA实现正弦波（周期信号）的产生
https://www.eeworm.com/dl/fpga/doc/18529.html
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教程资料 这是一个用C语言写的SPI读写FPGA的典型代码

这是一个用C语言写的SPI读写FPGA的典型代码，具有一定的参照开发价值
https://www.eeworm.com/dl/fpga/doc/18652.html
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模拟电子 50个典型经典应用电路实例分析

50个典型经典应用电路实例分析
https://www.eeworm.com/dl/571/20676.html
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模拟电子 50个典型经典应用电路实例分析

50个典型经典应用电路实例分析
https://www.eeworm.com/dl/571/20781.html
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模拟电子 50个典型电子线路集合

50个典型电子线路实例详解
https://www.eeworm.com/dl/571/21151.html
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模拟电子 虚拟实现技术在典型差动放大电路特性分析中的应用

介绍了差动放大电路演变历程，理论上分析了典型差动放大的工作原理以及特性参数的计算公式：应用虚拟实现技术一Pmteus软件进行了静态特性、差模输入信号、共模输入信号的实验研究，并对实验现象进行了分析。
https://www.eeworm.com/dl/571/21157.html
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模拟电子 低功耗高速跟随器的设计

提出了一种应用于CSTN-LCD系统中低功耗、高转换速率的跟随器的实现方案。基于GSMC±9V的0.18 μm CMOS高压工艺SPICE模型的仿真结果表明，在典型的转角下，打开2个辅助模块时，静态功耗约为35 μA；关掉辅助模块时，主放大器的静态功耗为24 μA。有外接1 μF的大电容时，屏幕上的充放电时间为10 μs；没有外接1μF的大电容时 ...
https://www.eeworm.com/dl/571/21384.html
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模拟电子 时钟分相技术应用

摘要: 介绍了时钟分相技术并讨论了时钟分相技术在高速数字电路设计中的作用。 关键词: 时钟分相技术; 应用 中图分类号: TN 79　　文献标识码:A 　　文章编号: 025820934 (2000) 0620437203 时钟是高速数字电路设计的关键技术之一, 系统时钟的性能好坏, 直接影响了整个电路的 性能。尤其现代电子系统对性能的越来越高 ...
https://www.eeworm.com/dl/571/21436.html
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模拟电子 运行典型高速ADC评估板设置

运行典型高速ADC评估板设置
https://www.eeworm.com/dl/571/21504.html
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