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倍频电路 的查询结果
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VHDL/FPGA/Verilog 这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器
这是用VHDL 语言编写的参数可以直接设置的2n倍时钟分频器，在运用时，不需要阅读VHDL源代码，只需要把clk_div2n.vhd加入当前工程便可以直接调用clk_div2n.bsf。
单片机开发 PIC单片机控制FM1702SL源程序+原理图 FM1702SL射频模块底层驱动源程序,适用于PIC内核单片机,电路原理图为Protel 99 SE格式。
PIC单片机控制FM1702SL源程序+原理图
FM1702SL射频模块底层驱动源程序,适用于PIC内核单片机,电路原理图为Protel 99 SE格式。
嵌入式/单片机编程 射频卡读卡电路和程序,以及网络芯片8019的电路和程序,功能是实现一个射频卡读卡,读出数据传输到上位机.通过网络.
射频卡读卡电路和程序,以及网络芯片8019的电路和程序,功能是实现一个射频卡读卡,读出数据传输到上位机.通过网络.
VHDL/FPGA/Verilog 5倍分频的vhdl代码
5倍分频的vhdl代码，经验证此代码是正确的，并且已经使用。
VHDL/FPGA/Verilog 用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.
用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.
其他 一个倍压整流电路参考
一个倍压整流电路参考， 一个倍压整流电路参考
VHDL/FPGA/Verilog 一个可实现多倍（次）分频器VHDL源代码设计
一个可实现多倍（次）分频器VHDL源代码设计
GPS编程 GPS接收机射频前端 电路原理与设计
GPS接收机射频前端 电路原理与设计
matlab例程 用matlab计算并成图形的电路设计中幅频=相位响应图
用matlab计算并成图形的电路设计中幅频=相位响应图 ，也可为设计计算带通滤波器的中心频率以及Q值提供参考
VHDL/FPGA/Verilog 有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的. 练习三 利用条件语句实现计数分频时序电路 实验目的： 1. 掌握条件语句在简单时序模块设计中的使用； 2. 学习在Ver
有实验结果,用MOSIN6编写的,是Verilog HDL语言实现的.
练习三 利用条件语句实现计数分频时序电路
实验目的：
1. 掌握条件语句在简单时序模块设计中的使用；
2. 学习在Verilog模块中应用计数器；
3. 学习测试模块的编写、综合和不同层次的仿真。
练习四 阻塞赋值与非阻塞赋值的区别
实验目的：
1． 通过实验，掌握阻塞赋值与 ...