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倍频器 的查询结果
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VHDL/FPGA/Verilog vhdl语言描述分频器
vhdl语言描述分频器，实现2、4、8、16……分频，经过实践
VHDL/FPGA/Verilog verilog分频器～时钟为50hmz
verilog分频器～时钟为50hmz，波特率采用9600bps～
VHDL/FPGA/Verilog 使用XILINX的FPGA进行简单的倍频
使用XILINX的FPGA进行简单的倍频
单片机开发 用于摄象机同步控制LED闪光灯的代码,LED闪光是已经倍频过的,不会引起人眼视觉上的闪烁感.
用于摄象机同步控制LED闪光灯的代码,LED闪光是已经倍频过的,不会引起人眼视觉上的闪烁感.
VHDL/FPGA/Verilog 奇数分频和倍频
奇数分频和倍频，只需修改参数就可以实现较难得基数分频和倍频
VHDL/FPGA/Verilog 3倍频实用稳定算法的VHDL实现（XILINX CPLD）
3倍频实用稳定算法的VHDL实现（XILINX CPLD）
其他 如何给时钟倍频或者分频
如何给时钟倍频或者分频，以及altera提供的IP核使用方法
中间件编程 使用verilog编写分频器
使用verilog编写分频器，包括奇分频和偶分频，可以进行任意奇偶分频
其他 任意整数分频器的vhdl源程序,放心使用. 无版权问题,欢迎copy.
任意整数分频器的vhdl源程序,放心使用.
无版权问题,欢迎copy.
VHDL/FPGA/Verilog 分频器
分频器，自己尝试编辑的，20和40分频，可以