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信号调理器 的查询结果
VHDL/FPGA/Verilog 设计一个四路数据选择器,其功能是将四组不同的数据按要求选择一个输出.输出的那组数据有两个控制信号决定,其真值表如下: 数据选择控制端 输出的数据 Input0 Input1 output 0 0 o
设计一个四路数据选择器,其功能是将四组不同的数据按要求选择一个输出.输出的那组数据有两个控制信号决定,其真值表如下: 数据选择控制端 输出的数据 Input0 Input1 output 0 0 output0 0 1 output1 1 0 output 2 1 1 output 3
汇编语言 电子抢答器 系统复位后进行抢答．超前抢答显示犯规信号
电子抢答器 系统复位后进行抢答．超前抢答显示犯规信号
DSP编程 使用DSP的片内AD转换器来实现模拟信号的采集！该程序很好用！经过本人验证！
使用DSP的片内AD转换器来实现模拟信号的采集！该程序很好用！经过本人验证！
微处理器开发 第3章－μCOS-II基础实验 3.2－GPIO实验 3.3－时器实验 3.4－PWM实验 3.5－RTC实验 3.6－信号量使用
第3章－μCOS-II基础实验
3.2－GPIO实验
3.3－时器实验
3.4－PWM实验
3.5－RTC实验
3.6－信号量使用
matlab例程 将输入A律PCM编码器的正弦信号采样,进行PCM编码
将输入A律PCM编码器的正弦信号采样,进行PCM编码，求出编码器的输出码组序列。
VHDL/FPGA/Verilog 基于地址总线接口的四倍频编码器信号接口的 FPGA实现 Verilog HDL的
基于地址总线接口的四倍频编码器信号接口的
FPGA实现 Verilog HDL的
微处理器开发 基于S3C44B0X微处理器,通过A/D转换器读入模拟信号伏值,对ADC进行测试
基于S3C44B0X微处理器,通过A/D转换器读入模拟信号伏值,对ADC进行测试
VHDL/FPGA/Verilog 微波炉定时器集成电路的设计 1、 控制状态机：工作状态状态转换。 2、 数据装入电路：根据控制信号选择定时时间、测试数据或完成信号的装入。 3、 定时器电路：负责完成烹调过程中的时间递减计
微波炉定时器集成电路的设计 1、 控制状态机：工作状态状态转换。
2、 数据装入电路：根据控制信号选择定时时间、测试数据或完成信号的装入。
3、 定时器电路：负责完成烹调过程中的时间递减计数和数据译码供给七段数码显示，同时还可以提供烹调完成时间的状态信号供控制状态机产生完成信号。 ...
其他 S3C44B0X 具有 8 路模拟信号输入的 10 位模/数转换器（ADC）
S3C44B0X 具有 8 路模拟信号输入的 10 位模/数转换器（ADC），它是一个逐次逼近型
的 ADC，内部结构中包括模拟输入多路复用器，自动调零比较器，时钟产生器，10 位逐次
逼近寄存器（SAR），输出寄存器如下图所示。这个 ADC 还提供可编程选择的睡眠模式，
以节省功耗。 ...
其他 电话计费器程序/*信号定义： clk： 时钟信号
电话计费器程序/*信号定义：
clk： 时钟信号，本例中其频率值为1Hz；
decide： 电话局反馈回来的信号，代表话务种类，“01”表示市话，“10”表示
长话，“11”表示特话；
dispmoney： 用来显示卡内余额，其单位为角，这里假定能显示的最大数额为50 元
（500 角）；
disptime： 显示本次通话的时长；
write,read： 当write ...