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信号延时 的查询结果
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matlab例程 信号在信道进行传输时
信号在信道进行传输时，经常会出现串扰，采用基于最大似然序列估计（MLSE）的电子色散均衡器的方法，克服光纤通信中的由各种色散引起的码间干扰。
研究基于最大似然序列估计（MLSE）的均衡器，采用维特比算法实现，用matlab仿真出采用MLSE后的性能指标（眼图和误码率）的提升。 ...
通讯/手机编程 本人编写的信号滤波并重构
本人编写的信号滤波并重构，实现雷达信号的定位时延计算。
matlab例程 基于MATLAB的正交相移键控QPSK编程,根据信号流程编写源程序,并通过时域图表示信号流程
基于MATLAB的正交相移键控QPSK编程,根据信号流程编写源程序,并通过时域图表示信号流程
DSP编程 用于信号处理里面的时频分析
用于信号处理里面的时频分析，可以直接用于matlab里面
其他书籍 信号与系统时域、频域分析及MATLAB软件的应用
信号与系统时域、频域分析及MATLAB软件的应用
matlab例程 对多径信道的仿真 输入码元,是一行矩阵,可以是实数也可以是复数 ％fs是输入码元的比特率 ％fd是多普勒频移 ％n_delay是多径信道的径数 ％t_delay是多径信道各径的时延时间 ％
对多径信道的仿真
输入码元,是一行矩阵,可以是实数也可以是复数
％fs是输入码元的比特率
％fd是多普勒频移
％n_delay是多径信道的径数
％t_delay是多径信道各径的时延时间
％p_delay是多径信道各径的功率db值
VHDL/FPGA/Verilog 用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.
用VHDL实现数字频率计,1. 时基产生与测频时序控制电路模块2. 待测信号脉冲计数电路模块3.锁存与译码显示控制电路模块4.顶层电路模块.
VHDL/FPGA/Verilog 本程序为模拟可校时的时钟程序；clk--时钟信号,rst--清零信号,set_en--校时 使能信号,faster--快进信号,slower--快退信号,hour--小时校时,min--分钟校 时
本程序为模拟可校时的时钟程序；clk--时钟信号,rst--清零信号,set_en--校时
使能信号,faster--快进信号,slower--快退信号,hour--小时校时,min--分钟校
时,（hh,hl,ml,mh,sh,sl）--时，分，秒显示信号。
校时的时候，秒清零。
matlab例程 对于dsb信号波形的仿真。包括时域波形和频域波形图
对于dsb信号波形的仿真。包括时域波形和频域波形图
matlab例程 ami信号的波形图。包括时域波形
ami信号的波形图。包括时域波形，和频域波形