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https://www.eeworm.com/dl/663/398979.html
VHDL/FPGA/Verilog
智能控制交通灯。分主路辅路
智能控制交通灯。分主路辅路，当辅路无车时主路保持绿灯，当辅路有车通过时辅路亮绿灯，并且在最短五秒钟之后或者20秒之内返回原来的状态。
https://www.eeworm.com/dl/663/399411.html
VHDL/FPGA/Verilog
Verilog HDL语言设计的交通灯设计
Verilog HDL语言设计的交通灯设计
https://www.eeworm.com/dl/678/425510.html
系统设计方案
对某省交通网久网络进行改造
对某省交通网久网络进行改造，文档内容包括拓扑设计，IP规划，VLAN划分，以及配置说明等详细内容。