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交织器 vhdl 的查询结果
VHDL/FPGA/Verilog 测频器
测频器，用VHDL语言编写。新手学习作品，还有好多不完善的地方，全当交流，也希望能下载本站原码学习。
串口编程 这是一个编码器的实现的程序
这是一个编码器的实现的程序，用VHDL语言实现
VHDL/FPGA/Verilog 高手写的VHDL源码
高手写的VHDL源码，实现DDS跳频器功能
请大家多提意见
VHDL/FPGA/Verilog 【经典设计】VHDL源代码下载～～ 其中经典的设计有：【自动售货机】、【电子钟】、【红绿灯交通信号系统】、【步进电机定位控制系统】、【直流电机速度控制系统】、【计算器】、【点阵列LED显示控制系统】
【经典设计】VHDL源代码下载～～
其中经典的设计有：【自动售货机】、【电子钟】、【红绿灯交通信号系统】、【步进电机定位控制系统】、【直流电机速度控制系统】、【计算器】、【点阵列LED显示控制系统】
基本数字逻辑设计有：【锁存器】、【多路选择器】、【三态门】、【双向输入|输出端口】、【内部（缓冲）信号】、【编 ...
VHDL/FPGA/Verilog 数字计时器
数字计时器，使用VHDL语言编写，使用数码管显示，精确到ms
VHDL/FPGA/Verilog 8位相等比较器
8位相等比较器，比较8位数是否相等
-- 8-bit Identity Comparator
-- uses 1993 std VHDL
-- download from www.pld.com.cn & www.fpga.com.cn
VHDL/FPGA/Verilog 我是VHDL的初学者
我是VHDL的初学者，这是我自己编译的简单的几个VHDL码，功能有3-8解码器及其testbench,16位寄存器及其testbench和交通灯。
希望能和其他初学者一起讨论学习，并得到高手的指点
通讯/手机编程 提供了一个硬判决的viterbi译码器（2
提供了一个硬判决的viterbi译码器（2，1，3）
有源程序及算法描述，未成定稿，只供参考
（vhdl 语言描述）
其他 实现四位加法器的VHDL代码
实现四位加法器的VHDL代码，里面含有全加器的代码
软件设计/软件工程 本文主要介绍了50％占空比三分频器的三种设计方法
本文主要介绍了50％占空比三分频器的三种设计方法，并给出了图形设计、VHDL设计、编译结果和仿真结果。设计中采用EPM7064AETC44-7 CPLD，在QUARTUSⅡ4.2软件平台上进行。